对l138与fpga通信例程tl-devmem2的复现与使用 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[已解决] 对l138与fpga通信例程tl-devmem2的复现与使用

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发表于 2018-9-5 20:16:08 | 显示全部楼层 |阅读模式 |文章模式
硬件平台:omapl38F核心板;
( _4 O4 a1 J% n2 |# g复现方式:按照pdf:omapl38基于emifa总线与FPGA的通信测试进行例程复现,并将写数据部分提取出来进行使用;# E  l; x" S, M, W2 z
问题:在对fpga这边数据进行抓包观察时发现:
- v4 k+ p* [. ^3 F; ]. O' Q1、16根数据线仅有低八位在使用,高八位置一,当传输16bit数据时,会将两个字节按先小端后大端的顺序从低八位数据线按序输出;. F& P. R' T4 Q/ ^5 a5 N
2、同时地址线只有addr1,addr2,addr3三根是有效的,其他线长期置一,并且地址线并不随数据变化而变化,而是每隔8到11个写使能而进一位;
; |: D4 s- Y! z* t1 u& z; b3、emifa_clk时钟线并不能作为时钟提供给fpga,在对fpga另加其他时钟并对emifa_clk进行抓包时现象为长期置高;# W0 k" {1 H: K6 ?& j8 _5 i
4、片选emifa_cs2和写使能emifa_we的拉低时间比并不符合dsp与fpga通信时的2,3,2关系,请问arm与fpga通信时这个时序是什么,同时其依靠的时钟是多大,还是114MHz吗?
1 e3 z. O; c- c* N% O

最佳答案

你好,emif的问题我们这边基本确认了。除了fpga端下载bit文件之后运行这几条指令再发送数据以外,需要加载这个驱动:tl138evm-emifa-sram,还有两个情况::1.tl138evm-emifa-sram这个驱动有bug,导致地址发送出错。 ...

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发表于 2018-9-7 15:39:11 | 显示全部楼层
你好,针对您的问题有一下疑问:
/ k  u+ _7 U+ @& h# H" H8 X( {* h4 \5 u
; `+ k5 m6 B: S2 q" E, {/ p1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?! D3 n8 J8 f% e: e& u$ C
2.是否有确认过FPGA端的程序与DSP端的程序数据传输的位数是否匹配?
2 y8 L! k3 u7 Z2 R6 w! j# K7 K$ ?5 i0 }3 t
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 楼主| 发表于 2018-9-7 16:26:05 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 15:398 u5 J: S9 B4 t# K
你好,针对您的问题有一下疑问:
# J' t& Y5 i# |2 c  Z# n- i+ m7 J% x0 T/ \
1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?

7 Z; D% y! c0 h9 B: s& i6 [使用的是arm的例程tl_devmem2(贴的图是修改过的程序,写使能中间的长时间时序是由于arm端打印每次数据造成的);我没有用核心板上的DSP,只用了arm和fpga
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发表于 2018-9-7 17:06:59 | 显示全部楼层
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》) i1 x* W1 J. Q, D. k* M% [
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 楼主| 发表于 2018-9-7 20:43:44 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:064 x6 w* W4 J, i
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...
/ p( z) ]% b3 }
就是按照那个文档操作的,然后发现采用m或者h模式的时候数据线和地址线出现了上述现象。采用b时地址线出现上述现象
% `, m7 |9 a; s0 x; Z* B& x: v, `
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 楼主| 发表于 2018-9-17 17:09:55 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:06
/ r, l0 d3 F0 g. m  B) S9 v数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...

$ L$ C' S6 Y/ w: o  u陈工,这个问题咱们创龙有没有解决方案啊,为什么ARM和fpga通信时只能用8根数据线啊,而且地址线完全和数据不匹配,而且arm进行写操作基于的时钟是多少啊?麻烦您解答一下呗
+ M! f. K( U7 R
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发表于 2018-9-29 10:46:15 | 显示全部楼层
您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看一下。
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 楼主| 发表于 2018-11-10 16:06:15 | 显示全部楼层
广州创龙莫工 发表于 2018-9-29 10:46
! r6 Q# C: h# B  m+ h( W4 C# P  `- g您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看 ...

- z7 k! U) A' T采用的OMAP-L138F上ARM与FPGA数据传输程序基于文件《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》。; S; _9 y6 F: d! {" f6 U

( |- K: e0 G* L; k, D; C现在遇到的问题:. d3 t# U' {. A" g( v1 O% q
1、16bit数据线高八位没有初始化,传输只采用低八位数据线,且16bit的数据会在低八位数据线分成两个8bit数发出;% g- N, ~& \% V# M4 ~
2、地址线仅有低三位初始化,且变化方式与读使能不同步;emifa_ba1无变化;) f6 U+ N% ]' |. d! z

7 C3 u! c9 j2 ]5 [# i现象:
" `# b+ P! |' K$ J) [0 T4 g1、linux端运行./tl-devmem2 0x60000000 256 m 52428(1100110011001100)FPGA端现象; ]$ j7 _( C  a
G:\EMIF问题\输入(m52428): _2 ?' M& I" F. l0 q: w' a
G:\EMIF问题\m52428addr% q* T$ u) v* ?2 g  w
2、linux端运行./tl-devmem2 0x60000000 256 h 52428(1100110011001100)FPGA端现象
$ V! I1 K1 G, j3 h$ VG:\EMIF问题\输入(h52428)G:\EMIF问题\h52428addr9 `& ^: T* k' I  x
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 楼主| 发表于 2018-11-10 16:09:43 | 显示全部楼层

# `: ^  z1 ~) ]/ N$ D5 P7 x% ~: _6 n
& `" l8 X: L6 c0 Z

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发表于 2018-11-22 12:02:47 | 显示全部楼层
你好,emif的问题我们这边基本确认了。除了fpga端下载bit文件之后运行这几条指令再发送数据以外,需要加载这个驱动:tl138evm-emifa-sram,还有两个情况::1.tl138evm-emifa-sram这个驱动有bug,导致地址发送出错。2.FPGA端的程序也有点问题,频率太高,通信会出错。。以上的问题我们会在V2.1版本(目前使用的是2.0内核)更新完善上去。并且修改emif的FPGA端程序。新版本的内核发布时间是下周五(11月30日)
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