MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
0 O5 u& L* J  m& `# Zinput mcasp_ahclkx,
4 h  h! s, B0 F, Q7 D; s3 ]input mcasp_aclkx,( n3 K9 P% ~$ e# F! K
input axr0,- s: y3 }- R; |1 @% m

% z; }$ i3 q3 t2 M6 P# M" Foutput mcasp_afsr,# T+ d" K, L& J0 X6 A' ^! K4 ?; g
output mcasp_ahclkr,
' I3 q" C8 {1 m: |output mcasp_aclkr,& M2 |/ L3 v! {7 H/ v
output axr1,' y7 M6 o- ?4 M; p" H$ s
assign mcasp_afsr = mcasp_afsx;' V) E3 O8 J1 M9 w; }; y) r
assign mcasp_aclkr = mcasp_aclkx;/ S: o* M3 I! E6 M2 H  z
assign mcasp_ahclkr = mcasp_ahclkx;. M7 p: _( {+ \2 ^7 w
assign axr1 = axr0;
' J7 e; e8 F' ~  H

  n' }1 d8 S6 |( u
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

% O* f4 ?- F8 j3 g* j
static void McASPI2SConfigure(void)1 _6 p. h5 R! A" U% B
{8 N4 e8 e4 R' w
McASPRxReset(SOC_MCASP_0_CTRL_REGS);2 e# }# B1 O/ }$ D
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
2 i  ?$ O: e, b, AMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);: b8 Q, J- s+ U2 }0 x
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
2 q: c6 m' U$ e. ^2 w2 {McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
7 T- s* F; m" e1 L  _; n+ eMCASP_RX_MODE_DMA);
' w7 V3 s+ b9 m/ RMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,3 V0 d2 G( r, x4 N7 b# t* r
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */5 E$ Z$ P7 @1 @& o9 s$ Q1 Y3 C2 a
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, $ w8 J) ~. d/ l  _% \, X
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);/ j; w  ?$ l1 H% q3 o: w# ^
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, / G2 n& R7 [# N. p) \/ K0 S  ]
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
  ]- n! R$ o8 P7 X8 B1 eMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
1 C5 ^0 M% i& ]+ j8 ?5 g: J0 \. |McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
" N$ V6 I- g! x+ w3 ^  a/ DMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,% h: z5 {6 g+ ]  J9 m: G) u
0x00, 0xFF);
/* configure the clock for transmitter */0 C, G0 L3 j0 u4 n( g
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
" H" m" }6 r, x* z5 [: S& qMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
5 h$ ~5 y5 j9 HMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,, Q$ ^8 Q& o5 t5 w
0x00, 0xFF);% T0 n6 f6 H/ l0 g$ |2 b/ u8 F

) B6 {  p2 Q+ [: ]/* Enable synchronization of RX and TX sections */ 1 I9 ?! X, N3 `) [" u0 ^; H/ B
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */9 z* J& y7 D3 k# X( [
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);! Q; u  S" }/ N' Q
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*) O' h# h1 S. p3 P. v
** Set the serializers, Currently only one serializer is set as, c; g  d7 u, h) h
** transmitter and one serializer as receiver.
  t$ j4 z; m4 O# W* d6 D; \*/
9 K6 Y: T% F. U8 v" W& D( h% `McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);) Z* {+ ^" O$ I5 a/ D: X
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*) ]/ i7 L& y) i+ {1 T- Z7 ~
** Configure the McASP pins # |# Y0 u- i& j' [* e! W6 y6 _
** Input - Frame Sync, Clock and Serializer Rx0 Y* W- f, f7 t: w* A6 {
** Output - Serializer Tx is connected to the input of the codec
6 b  e" k2 D' a; r( c0 j0 l*/7 y% w7 W3 R4 G8 l( D
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);5 I4 S( P; @! d* q2 h" ~
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
4 n& d( \* D# s: B; H8 TMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
6 P' L- L3 f" F5 @( o4 T9 H0 O2 _| MCASP_PIN_ACLKX! ]: w  j# B/ b: U* X& |5 J
| MCASP_PIN_AHCLKX
# @0 ^6 ^: M7 ]% @7 x5 v| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */4 n1 H& Z* @' o3 V- D& R* D9 `
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ! G! E# A5 h0 |. |! T4 \: T$ w6 A- O+ i
| MCASP_TX_CLKFAIL
9 G! K; c* g2 A. {+ h$ l| MCASP_TX_SYNCERROR7 v5 V6 t, _. L9 K7 v) @
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
. ?" J, l; r3 C& w' c+ w| MCASP_RX_CLKFAIL* A( q+ F% |8 B# U
| MCASP_RX_SYNCERROR : \# z/ k2 n0 N
| MCASP_RX_OVERRUN);
/ W$ e# ~, c1 n3 |# {  Q}
static void I2SDataTxRxActivate(void)
$ k5 p1 K; a& m{- x8 u, Z: v2 \5 T4 ^+ l% h
/* Start the clocks */. p+ v- `" l8 Z5 G: W; b
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
2 ~" f1 O% N0 ^7 S' oMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
( T+ v( H: ^4 g, @' eEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,/ j0 a+ B& ^) Z; `2 o' ~
EDMA3_TRIG_MODE_EVENT);
0 v# u' V! Y: @& B! JEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
! l9 H# q' C/ Y: \% ~& Y6 kEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */2 ^  j5 n" A2 m, a, l. D& j* u
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);4 u! n! X% ~5 l% A: b
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */! d( k& W8 T! g: e3 y+ ]7 c. h
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */7 z8 y! R% V/ c$ {& x" y
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);7 q; ]. I& w1 h3 A/ \7 g3 u  p
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);0 r- q) P; R& ~; ~( |$ ~) l
}
! A. k' h( U! d0 W, j3 b
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
, k+ |% E8 F5 f% z& {" j
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