MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
) m9 `6 r! b7 g( finput mcasp_ahclkx,
! N0 P3 l2 o. `6 Y; ~, N1 xinput mcasp_aclkx,8 J1 W, O6 V. N+ e) [( |: c6 ~
input axr0,
/ l% `8 }+ L. |
8 t& F/ A( P0 V% g5 Y0 [4 m8 ~output mcasp_afsr,8 B; H# g* |) r* U
output mcasp_ahclkr,; t  M0 B' n. X4 H, ?# @
output mcasp_aclkr,5 g* Q$ y" {  y% _$ m+ v
output axr1,. F; C. ?) U# x# i' [
assign mcasp_afsr = mcasp_afsx;$ U5 Q4 O+ p$ [
assign mcasp_aclkr = mcasp_aclkx;7 M) `, u1 k, |4 x( \3 L
assign mcasp_ahclkr = mcasp_ahclkx;) X/ K! i* z6 _. {$ C+ l/ O
assign axr1 = axr0;
1 h) M3 e' b5 N& i8 b5 t6 t

4 Z# y% `/ }; n6 v9 X
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
9 i; P6 v4 s5 v& Q, t5 }
static void McASPI2SConfigure(void)
* M6 q* E8 v; \/ S) Y) z{
8 Z5 @( Y# X1 _7 HMcASPRxReset(SOC_MCASP_0_CTRL_REGS);. J5 m& v9 H/ B. B4 H: }5 _# a
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */) F6 \. U- D5 Z! c, }
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
0 A: F6 `( t/ x( {McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */. ^+ K/ y: F+ G
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,2 E- x* H4 I* l& D
MCASP_RX_MODE_DMA);7 E4 A, M' X% o( D+ H! m3 j; g0 N
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  [+ S) H# e% I
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
* v! u" p) j' n  p7 gMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ! F) a. r# o3 X! u2 m
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
' Z) b$ i9 ]$ [6 z/ D3 lMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
- C& _# `  _3 N9 m7 d" lMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */! {3 f( _. a  \: E
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
4 P! J5 _/ Z9 k, lMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); % V& _3 }/ y" X( q8 o* F; o% f; V
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,, S8 S; w/ f* x
0x00, 0xFF);
/* configure the clock for transmitter */
9 W) Z" z7 @9 u9 `McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
; L. u: N8 k2 a. y5 f( R/ |% IMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
! [: \5 A( U' L" G/ OMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
( f% w9 j. d' \0 [, I/ l: {0x00, 0xFF);0 j& u) f) ~9 R( a. n1 q
- [& G2 ]: V3 @  Q1 K' }
/* Enable synchronization of RX and TX sections */ # F+ d3 k/ e4 t7 l- @9 P/ f1 ]# p3 a1 j
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
0 p1 n+ n9 c; w9 z% g" L' BMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);0 S9 j' A) |% Q0 n0 R! b9 j
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
/ l4 g" V) V1 k$ _4 m* c** Set the serializers, Currently only one serializer is set as
2 T5 g# i' l) R- D  V' p0 d0 C; b** transmitter and one serializer as receiver.
' \. M$ n* l" ]$ V9 ^*/
: c& K8 V  b) E; F9 h& HMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);1 i7 m$ {9 d+ Y/ h8 Y
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
* X/ I2 A& P; [1 I3 ^* a** Configure the McASP pins 4 C9 k. ]3 i  P4 W5 ?: K9 N
** Input - Frame Sync, Clock and Serializer Rx
1 K# I8 y$ S5 _, [4 t** Output - Serializer Tx is connected to the input of the codec 9 `) w$ ^# K3 H$ G% |$ i  G/ X+ L
*/
" d0 q& L  \8 K- L- f2 jMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);: P% [# \- \; ?# o( ]- x
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
  Y& y4 C% z+ u& Y2 IMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
& B  o- Y( N5 @, f9 C# o| MCASP_PIN_ACLKX2 H3 Q9 w: k! S4 B0 y. S
| MCASP_PIN_AHCLKX
. B  n) t7 {* b+ R, d| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */: S# @- [8 r7 Z* v+ g& a7 a) N+ |
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR + ^4 T) Y) ^4 B! F% V
| MCASP_TX_CLKFAIL + C3 r' Q- n; K* v$ l
| MCASP_TX_SYNCERROR: q9 P) K+ O9 l4 y
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR : [1 N3 i+ G; e  P7 B9 x# G7 l" h
| MCASP_RX_CLKFAIL1 H$ o2 t1 \3 H; H  D) {) F) o  t
| MCASP_RX_SYNCERROR 5 G# s* ^9 }9 j, f% n: I# |
| MCASP_RX_OVERRUN);
1 }/ ^) |. O7 S% ~' y6 d}
static void I2SDataTxRxActivate(void)
% t, b9 L( ?2 p+ }- C% d{0 \6 O9 x# ?6 G) {. l
/* Start the clocks */
4 q" o1 X4 n! L* m3 |4 o5 R* F( EMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);$ q1 Y4 a9 j+ \9 D* ^' n% z. u5 `
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */2 x7 p3 g# E6 p/ S4 u* f
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX," h* r2 c6 l0 A5 ^: v
EDMA3_TRIG_MODE_EVENT);
4 Q2 d% `8 }# a! ]: \$ C4 w' bEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, & }* G" j  R9 ]8 ]* |! `; D
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 z5 N. y- b) @. yMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);4 f; _1 Z) B0 ~* P7 B$ l) t
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */* l; G6 S% C# y
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */  A" h. h4 M$ H& d; b2 W6 t
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
& c* X% v8 [& _9 t# ]( j6 BMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
( S1 j# C4 v2 f* l% u9 F}

( w& Q2 Q% `$ X
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

1 ^8 q3 G& O1 k) D0 e
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