MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,) }' v( n) `* `( \6 k  k
input mcasp_ahclkx,
$ d- }' P+ Y' N$ t( Pinput mcasp_aclkx," L- v" H3 j  q
input axr0,; d7 k" q& J1 V' w/ J5 a3 T
# k1 ?% g" A3 q( k( _! ~
output mcasp_afsr,
( u# |" J3 e# Y) A- P/ koutput mcasp_ahclkr,* A6 z" M2 t% p" I" h! r
output mcasp_aclkr,8 z0 t; h- |- s6 }2 {" h! `: H4 K3 S
output axr1,' O* X8 [" H' p5 ~! t( S
assign mcasp_afsr = mcasp_afsx;
4 v& H) \  q* Hassign mcasp_aclkr = mcasp_aclkx;
. W0 ^& s* B$ c. T, q! Q+ \! m8 v0 vassign mcasp_ahclkr = mcasp_ahclkx;
% W4 V6 i- H  K  |8 n4 ]3 Lassign axr1 = axr0;

  H- T  y9 I, K8 O1 Z- M+ t3 E4 L
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

' {% `6 a5 T0 H
static void McASPI2SConfigure(void)/ F" k& M3 N5 T0 e4 ^9 b: L! G3 i- H: K
{! F3 w6 a6 A. h! K/ h% q* M* r
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
# f+ u* y8 O& m9 t; V" jMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
/ Q6 I& X" ?! V. dMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);. ?& F$ {( w( x: R% ?' s) p. ~8 p2 k
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
# g& P) _- C0 M# n1 B9 Z5 UMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' p! f1 L" d) d2 b
MCASP_RX_MODE_DMA);5 ]/ O$ ~8 g1 G; S
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
+ i  d8 P9 @) o+ HMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */! b- q* a' {$ H, O5 k
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 1 U9 |6 c1 X7 y" C2 I
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
( ]+ i& m/ I% sMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
% y5 K2 B+ E( S) b& r1 nMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver *// m+ A! n) L' y
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
; S& X' R* Z8 R1 eMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 3 d# @9 ?- o5 O/ d( a: R+ R
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
2 |' e9 _, ^0 o# V) E- m7 l0x00, 0xFF);
/* configure the clock for transmitter */
7 {. y7 L7 O2 k8 {( q1 gMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);# g! ^* |/ l/ {% ^5 t# ^7 d
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
$ s! ^+ t4 o) E; _0 e' J, RMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
9 ~- Q5 E4 K) Z4 Y( X$ B! m0x00, 0xFF);
  L7 z6 a. \/ |$ o+ \; }
+ t; Q* j6 b/ Q/ p% Q/* Enable synchronization of RX and TX sections */ 2 v! M# u* C3 {/ U
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */% v4 y% E7 u. e. {( e$ c! h9 f, i
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);, Q# |$ W7 ^% s0 L- ^
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
  d1 `6 Y' E, v1 x7 [8 [5 s** Set the serializers, Currently only one serializer is set as
* o, }$ N. [0 ^** transmitter and one serializer as receiver.8 o/ o, u) ^8 S6 z- o) }2 S
*/. ]9 @0 s& W" `+ w+ _
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
' [5 i$ \( @2 S3 d* C4 ZMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*; ^' q: e  s" B- |' R) v  Z
** Configure the McASP pins
% W' n3 V% Y- H** Input - Frame Sync, Clock and Serializer Rx8 n6 m* K9 Y+ X4 S5 S
** Output - Serializer Tx is connected to the input of the codec
( z- T; e2 i" r5 k0 B' S7 a8 t, e*/
! K: k' G4 v4 P) ~2 E3 YMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);' @8 ~. q- o6 a
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));* m0 |, |: y) Y% o
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
6 V* Z! F8 z3 z* J$ J| MCASP_PIN_ACLKX9 b2 S% e) X' U0 I& |
| MCASP_PIN_AHCLKX
# E1 i9 F2 T' d0 s" S0 A# z& N9 S; F| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
% ?; X" l; C5 X7 XMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ! u/ I& ~/ O  X
| MCASP_TX_CLKFAIL ; m" M: N/ h: V  j+ z' Y
| MCASP_TX_SYNCERROR
2 C6 h) [. Y7 {" V/ V# @| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ' R0 j; z: V) G% }" j: y
| MCASP_RX_CLKFAIL; y# M: d9 ~7 L6 T" H3 l8 H
| MCASP_RX_SYNCERROR
5 p4 S& A: e! M0 V: A9 S2 x| MCASP_RX_OVERRUN);1 ~( q1 U0 X- _2 [: N0 v
}
static void I2SDataTxRxActivate(void)
/ }* ~, j2 q! E2 A{- Q7 `! |4 b8 Z6 `
/* Start the clocks */
) z6 g" [* D1 Y( w: r" ]1 @9 C8 mMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);+ s- M: t7 l1 g8 u# Q9 @0 b
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
7 Y+ i3 ?/ W' Q2 ?- W. \. Y  AEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
; o" A! V3 [, J; _7 o  }EDMA3_TRIG_MODE_EVENT);$ N, Q9 B# a: k, j0 h1 t. D
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
) n3 o/ t. e0 L# Z( cEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 R5 A8 Y; o( i0 _% iMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
* q, ?* W; h/ W* d/ S" MMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */7 F: ?8 \- t" s3 S/ u1 A3 h; Z
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */% T, O$ J( a! J/ k4 a  E( K2 N$ A' t
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);- W6 H+ [* j  s/ I& _  X
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);. M( {1 O5 x9 Z2 Q% ^/ \1 I8 L
}
  n- S6 Z2 k$ d! {
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
2 B2 t3 S0 r3 I$ L& c
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