MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,7 B% {" J+ r9 f# R9 |' y
input mcasp_ahclkx,. Y/ Y9 H7 w( b% d) L) ]: @- ~
input mcasp_aclkx,
( m0 p( j1 |  {  hinput axr0,* }' O5 Z4 b2 D3 q
4 ?* f/ V6 [  a2 z! L' f. m4 q
output mcasp_afsr,
: u- v4 D8 f, E+ Ioutput mcasp_ahclkr,
' i+ v+ s1 W0 \7 T' i2 \0 @output mcasp_aclkr,
% e+ @% {" O8 C; t( @4 X6 Toutput axr1,
2 l' y. G: T$ r: r4 G; z+ S
assign mcasp_afsr = mcasp_afsx;
. S# b, }$ t+ L" @& C! {( b" h! q. T( dassign mcasp_aclkr = mcasp_aclkx;, r" c* ]$ Q; B* V# c
assign mcasp_ahclkr = mcasp_ahclkx;
/ j/ J2 i$ d+ B: c$ [9 \assign axr1 = axr0;

8 C4 z5 n8 N2 o2 Z. I3 \( ]& V
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

% h- i, @" J, R/ s  ?8 m
static void McASPI2SConfigure(void)
. c  m; F! ~  j2 D# Y, f0 w{
* t% g7 F8 {- h/ UMcASPRxReset(SOC_MCASP_0_CTRL_REGS);, S& P, U. U' h8 _6 g
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */6 R- z0 y- p/ U; t+ b. ]7 S: [6 W& A
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);3 T- P; [+ d+ B: ^& X1 O
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */- O& [" ~' ~: I; ~9 ~6 V" I
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
) U0 P. v: k* z# }$ o  g# TMCASP_RX_MODE_DMA);
# Z$ f' A3 b  \* M) B. jMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,# i. v0 [6 S8 T
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */9 z! ]; U8 g' L
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, " _  k' J4 i( ]1 R
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);. T3 d5 l  p6 \5 ~/ |
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, $ x- H- c+ h4 c7 W8 W
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
% Q1 j. f# \! s" {# T) H" o+ q5 gMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
7 B( G1 v. g) v& D! u. QMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 0 a( }2 D0 u2 p+ U* h* B* P
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,  c( ]7 ^' ?6 k5 B
0x00, 0xFF);
/* configure the clock for transmitter */
, d+ u/ s5 B* a. UMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);* e! j7 ]' i( e& w
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
: y/ I- y2 h5 M% x3 R; bMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
/ _9 d( O" R4 f8 \4 N! g- `# P0x00, 0xFF);7 c8 u2 S# N' l# z% L3 I

7 p' o; E1 O/ V, |1 I/* Enable synchronization of RX and TX sections */ ; M) z, Q+ E4 [* j3 `
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
" z/ D4 L5 `& a6 p& ~5 tMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);; E% D9 }: L* X& X
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*  t1 e; ]) n, }5 m' s& ~' I' N+ {
** Set the serializers, Currently only one serializer is set as% o# w, O: X% W
** transmitter and one serializer as receiver.
$ i$ k; I2 A7 Q& Z' t9 f*/& T6 G; y6 b' @2 x
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
% `4 `1 d4 o: ?  {McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
% E. C* e" D9 n$ q* E$ w7 @  `9 {! B** Configure the McASP pins * Z: I, g. Y+ m' b3 q& o1 q
** Input - Frame Sync, Clock and Serializer Rx
/ k$ A4 t# b4 H5 R& Q$ P' n** Output - Serializer Tx is connected to the input of the codec * g5 Y4 }5 c! w0 k! h9 U* ~
*/
4 N% |: z$ s0 s( TMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
* p4 s1 |, C3 C8 n& T6 iMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
2 p+ q. f5 m4 O, R( Q) zMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
: g0 d4 R" H' N8 l0 W6 I  h! M| MCASP_PIN_ACLKX
" x3 b2 |. m) I# h/ a| MCASP_PIN_AHCLKX
- v4 n* D4 c; ?: B4 @+ k0 j: a| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
4 J  m6 W! u* n2 i; i: ^( OMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
  N6 r3 r  Z7 _# b2 T( w9 W| MCASP_TX_CLKFAIL 7 E$ O8 W& g' d3 S! g, S
| MCASP_TX_SYNCERROR
$ ]. s% c4 \7 E1 o/ q! ^- F2 G| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR . q. N/ U) J" s7 d
| MCASP_RX_CLKFAIL
% ?3 X% R! o- g9 F( {| MCASP_RX_SYNCERROR
' x1 m+ i8 L* _: r, X; V7 w; L( [: K| MCASP_RX_OVERRUN);
; M! ]) a* o; \& p8 g1 m}
static void I2SDataTxRxActivate(void)+ J9 v, M6 v& I3 ^
{
2 s+ z! d% _5 N0 {' B0 _) ]7 G; i, z/* Start the clocks */
' A( m! e' C$ i  \7 e8 f! rMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
7 ^# X6 L, B( X# D$ GMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */( M/ n6 K$ k1 b% R1 z& U0 @& A
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
( }! d0 c$ N1 [" @6 o0 VEDMA3_TRIG_MODE_EVENT);
+ @% k8 V; a$ ~: f2 y) f4 w) a9 vEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, / O* s1 @8 U* ]
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */" w# _3 _1 ^  G
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
& j2 P( Q: L! t' RMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
  X9 `9 f& |7 x; m9 g8 v' X/ rwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
3 R' d- Y1 K. b- mMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ V4 d9 O$ y; X6 uMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
- X8 i: E" I2 k  [  F# a6 ^: U}
0 {" v8 s2 j; b1 q8 W6 P* j4 q
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
9 o2 h$ l9 x2 Y% A6 e3 B
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