MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,3 B0 Q. s. a8 V4 f8 X+ {4 a% g1 W
input mcasp_ahclkx,
2 q( y! |: a# r$ o& E4 t- w. x) ~( linput mcasp_aclkx,
( j) c$ k, \& `9 D* H" jinput axr0,
) {0 E3 ^# m; o4 E
% a0 l  m; _' r$ ^9 Foutput mcasp_afsr,
9 w6 N2 s  @1 K- M  t/ W0 C: o/ U- {! ]output mcasp_ahclkr,  ?6 m0 @, ]/ z, c3 }2 ~
output mcasp_aclkr,. C1 P8 N; A' F/ x6 y" v% X
output axr1,8 R3 H8 I# T# [! i
assign mcasp_afsr = mcasp_afsx;
* J2 j1 \/ c, {4 D7 L- ^  lassign mcasp_aclkr = mcasp_aclkx;
$ Y4 u) Y  V8 E/ Gassign mcasp_ahclkr = mcasp_ahclkx;! p* u1 G5 c) w2 R( B' R
assign axr1 = axr0;

" [! Q: G# f/ {4 Y# j! a( H$ A. \
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

& [/ i7 W, z- X# G# z
static void McASPI2SConfigure(void)
/ b7 U# k7 U$ O. `% R{6 b. c4 w6 C! _
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
* ], J5 R8 ]6 k, G) G2 qMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */) y3 H: y, u: j1 h: |
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
. l: I, M# k2 s9 M2 PMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
4 D  R" S9 r  I0 E* LMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
% C1 c3 S3 S$ O3 D4 D$ V0 KMCASP_RX_MODE_DMA);
& d$ t1 h" A. c$ ~. r# ^McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
& h0 X( c; R( \4 N+ E* ?" V0 _4 pMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */( B0 S! d& [/ _
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,   J4 |" _$ j* K
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);# n: M1 q6 W; N! h9 f" I
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
6 X% l% E/ X! j) [( @. OMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
- R$ q* Q* B& [  M& hMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);0 \$ l6 v( I7 n( w
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
% {; G: s( e4 g* J! n; |* XMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,5 g9 {+ i( u& `; O
0x00, 0xFF);
/* configure the clock for transmitter */- r. R5 `/ A  a
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
0 S- M" x5 `( v% nMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
% S3 S; u! r4 D4 @! |McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
* `1 _6 v  i! k. C0x00, 0xFF);
$ Q* C8 {) i* A- L1 |. m- ^7 q) }7 j5 z8 Z4 _
/* Enable synchronization of RX and TX sections */
. |# V- u: O! T  PMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots *// u4 j8 L5 O# ]& z* A
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
' U4 j: l$ j# x+ TMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
8 Z3 ~0 Q; T- ^: B** Set the serializers, Currently only one serializer is set as% l9 |8 ~# A8 g8 }9 C# R
** transmitter and one serializer as receiver.
2 Y' C, p) c' a9 E*/
" `& R6 H9 @+ d" QMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
& e+ R1 L, R) j, _0 o: t% cMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*; p" h! K, B0 C3 g& V) D& v) M
** Configure the McASP pins
; k- y, l  l$ g" D# _  N** Input - Frame Sync, Clock and Serializer Rx$ B# x4 S' |6 L5 H
** Output - Serializer Tx is connected to the input of the codec # S5 Z) y! y- S8 k6 \- h1 F  @9 v0 y
*/
% W0 l  H* B, t7 @: m9 d7 B$ lMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
# S% A+ j+ B+ \* u: VMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
' C4 ^/ O1 k0 P: ~2 P$ BMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
1 }, f; Q: p; E* m: r| MCASP_PIN_ACLKX3 z6 [: t2 n0 @2 B( R
| MCASP_PIN_AHCLKX& @; E* I; P/ m; x  u7 ?4 c
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */8 u6 Y8 d% U/ }! G9 L
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
4 N- O8 R! C+ {/ T| MCASP_TX_CLKFAIL ; M4 f4 \; B9 Z7 Z, t
| MCASP_TX_SYNCERROR$ r( G2 e( q0 x" M, f% [- I
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
( V6 D1 Q. G1 B& q  l$ @| MCASP_RX_CLKFAIL
6 [6 D8 E- m" S5 H- V| MCASP_RX_SYNCERROR + p9 _' ^7 Z# x- x, ?% K
| MCASP_RX_OVERRUN);+ n0 `' h4 g' |% H
}
static void I2SDataTxRxActivate(void)
3 P* o1 Q) V, k# s{
7 E: j$ p$ D- P: v/* Start the clocks */
- j4 n% A: @* A. d  C' \McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);- ^( ]* u; T& N; Q* v) j+ J
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
) R' @$ H" z, L+ {EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
8 d% z5 O( q0 ^) d" g/ W2 rEDMA3_TRIG_MODE_EVENT);2 e, Z0 B. S; E
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,   B& y5 C# r3 l  K0 v8 R+ Q5 X1 W
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
0 o8 O. h; v9 M6 K# zMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
  Q! r( o5 K/ i5 V- ^( x3 O. `0 t) R; OMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
0 Z/ r% J: Y% o. S  {# Rwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */) p. Y- W$ r) x
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
& h) U1 f5 g0 \# w$ |9 bMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);0 f* N8 \3 z6 t2 z
}

3 I) {7 d) w( W( g
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

, V1 r4 d) U( [" n1 ~  V) f+ y
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