MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,& F6 @2 S7 _- ?1 X
input mcasp_ahclkx,
- u2 Q; J+ l  a$ o$ j; yinput mcasp_aclkx,& ^+ h; H2 U; }( @1 w% Y% x4 B
input axr0,
8 f8 [- w3 s; O. S- D! \3 R/ B( p4 n
$ T% ]& z7 V! Y' @' aoutput mcasp_afsr,# {5 V7 X2 d' k7 E" l7 u
output mcasp_ahclkr,5 b: X* O# |4 b8 E" X+ ^& W2 A, d' }
output mcasp_aclkr,
* B9 G( h4 z. n* q  i/ H2 f# j9 houtput axr1,
1 y# b7 Z! ]* I0 n- U; |- r8 u
assign mcasp_afsr = mcasp_afsx;, I: V6 D$ {. ^9 ^  F/ D
assign mcasp_aclkr = mcasp_aclkx;: `1 K4 E. b* [
assign mcasp_ahclkr = mcasp_ahclkx;
, M: j& ~  {, ]" c7 v7 passign axr1 = axr0;

, D4 T; }( ]1 ?$ Y- y2 P. [4 X2 g3 A+ x' H+ i6 I2 n, J; o
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
8 d2 _9 b+ q% F" n0 K/ w
static void McASPI2SConfigure(void)
8 o/ v! h8 e# C5 f9 [3 w1 S{; _2 R, T5 m3 D. o- L
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
& o' w; |1 Z6 W5 S" M: S3 \9 d/ _McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */: D* E, h3 `6 t
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
; p7 i& \# c, Z" }! xMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
/ |% V) b  k( ~0 PMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,6 M  v* |0 |( m8 P8 Y; A1 r) n
MCASP_RX_MODE_DMA);
, m+ A6 F/ o, C/ `( TMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
9 f" k' V( h( }' B0 nMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */  m' L4 t) g" D" `
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, , q2 i- T6 S; G4 P
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
. h7 _4 ?8 `5 jMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, : p4 s% r* u9 |7 D
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
, Z( Y$ }  Q, X2 C: rMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);+ v( e2 S; z. {+ {) X6 x
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
0 X5 s$ s' v+ z& P3 t4 D4 p) t' nMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,+ |5 x' h0 j2 D
0x00, 0xFF);
/* configure the clock for transmitter */& Z- n+ `; Y  c$ p7 K; `* A
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
" ^0 K4 o7 \* MMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
/ w& G4 M9 S, s5 {McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,7 u+ E5 |8 M$ W) \0 T8 z( R8 D; P
0x00, 0xFF);
! @( X8 i# _9 S) p- A/ c
; }2 r2 O' R, x( B% b/* Enable synchronization of RX and TX sections */ % M: E9 R; v* u' O( L
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
; l) C0 M0 z- s# r" lMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);$ k- u1 ~' V( P2 y) W
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*' h# q; U% g0 u: ], h: `3 K8 S" i
** Set the serializers, Currently only one serializer is set as) s3 |* e  v& f7 o; @
** transmitter and one serializer as receiver.
9 [3 l) r# `) X* ^# E) k+ m/ _1 d*/
% M$ V4 H! V& G- v% [McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
5 K8 b' F# ^) |# C( E9 k. D1 k; dMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
; G" C0 g) ?1 l/ a** Configure the McASP pins % m1 f8 W& @- }- w& a6 R
** Input - Frame Sync, Clock and Serializer Rx3 q% s! P, O1 Z3 b6 x3 p8 A/ P
** Output - Serializer Tx is connected to the input of the codec % [/ s6 t0 K* b
*/
2 g9 E. }+ h) ~: D5 D1 kMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);5 ]' x) C( ^$ B0 K
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));0 C5 [: V( F% `$ v
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
# ]6 }$ |" n" V( s| MCASP_PIN_ACLKX# G! |( U& a$ k4 i" S4 b  u
| MCASP_PIN_AHCLKX
0 T) z# x8 b1 p9 ~| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */4 x: B6 |; E- V, o
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
& G+ d: f; H" _9 c0 L| MCASP_TX_CLKFAIL
2 U7 _6 ]# N8 @1 ?| MCASP_TX_SYNCERROR/ M" r. F( M6 x) V- I8 R: Y
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR . C5 J+ i# y- s# Q# k
| MCASP_RX_CLKFAIL( u( j# U0 ]( B
| MCASP_RX_SYNCERROR + U& @. i6 u2 W' D* h( L2 c& `
| MCASP_RX_OVERRUN);1 V  }8 U: }" |! I
}
static void I2SDataTxRxActivate(void)
8 a7 i6 h5 b2 Z1 O' x{
/ g: _2 n2 p+ ?. c/* Start the clocks */
7 `% _# s- {5 X. d* ?4 V: i! WMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);2 M" ~8 p2 k0 |3 `
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
* u7 N+ A" R+ h5 F* [EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,1 g5 `( y0 u. j
EDMA3_TRIG_MODE_EVENT);
0 N! x% N/ [" L/ k: EEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
3 A3 y! P1 ^0 m! G7 `* J; S( l8 s, GEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
, ]/ m+ q0 o" b4 f: Q1 _McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);9 _& C) j) x% j9 d7 @
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */- E- F' l: ?* J  Q3 \
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
: r2 b: D9 l: i$ I. t' K$ q( O* \5 CMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);7 d+ x: ?/ r; k7 g' s& Z
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);3 a# B: ~! K1 q4 _# p- _6 Z1 R
}
9 j. y/ d7 T' `; @* L/ I0 Q4 a
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
: s5 L4 J; Y0 i- V9 o$ }% F
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