MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
# E* P. q& Q2 J& r) K8 J+ Dinput mcasp_ahclkx,
# z7 ?4 x3 ^. `$ H& ~+ Rinput mcasp_aclkx,6 `9 ]3 E$ S* D; [' e/ R, F4 D
input axr0,
0 }/ u# K; P& i/ d
! o' r# a6 h" M% `; n" V! Voutput mcasp_afsr,
9 R% E/ Y8 h9 ]2 Xoutput mcasp_ahclkr," N" n4 l4 w7 `; i" X! p/ J' V
output mcasp_aclkr,( V7 ?( R) D+ w7 F+ X
output axr1,9 B5 ^# T8 @6 v+ T# C
assign mcasp_afsr = mcasp_afsx;+ e* A( p" C9 L4 C4 o
assign mcasp_aclkr = mcasp_aclkx;
! I- N  j3 ?; b$ r6 t- dassign mcasp_ahclkr = mcasp_ahclkx;# a: d4 P% D) _; n- o$ i
assign axr1 = axr0;

: `9 o% n" G4 N) B1 V1 }$ {' [: D; s5 V/ p  ^
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
+ f2 ~8 \3 B9 n# S: i( N$ ~
static void McASPI2SConfigure(void)
' f, z! S! T" d3 g: y+ ^# @{! c7 z, |9 C9 U. x6 b0 I7 q, i- E& R$ d
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
' ~8 l" o/ A$ g- a* J" {0 z1 kMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */! V( A3 [% {# L3 H
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
* f; Q* Y) b6 G8 TMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
: F" J  {) [1 O( C0 qMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
1 l3 M) L: s- F6 T* `MCASP_RX_MODE_DMA);
. G0 V: g) r' J- i! K  vMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
2 n; B) F1 K. \MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */) B8 c- c, }+ V9 _# ?
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
! f- p% q( g7 _. Q$ L2 _/ ZMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
5 c0 `4 p; X2 o# jMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
- ^# e; h. R% A2 y$ HMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */) h  m0 ^) T% `0 T6 |5 d* S
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);. |' i' J/ T6 U# i; u- P$ [4 P- V  `
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 6 k4 V2 w( @1 ]+ R6 {. B
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,$ U5 Q0 z* A! C, r- F; S8 J7 X( R
0x00, 0xFF);
/* configure the clock for transmitter */+ B0 z1 f; A6 ^7 j! E4 E( R
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);( Y* I" R. H8 k" A0 R  a% p
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
1 r6 w& _) I, K5 u* I9 Z% QMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,. \; y" f3 m& R  j1 M! O& n5 _
0x00, 0xFF);# ]: ?. m0 o: z( o7 [# |+ P

; j' @  H! w! R$ n! d: g" _; @/* Enable synchronization of RX and TX sections */ 8 i4 {2 A" t& V5 S9 }! N7 R
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
) a, h# J. |& }9 V! {& QMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);# U3 `) h7 t) b- Q
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*: m& U  G8 @) [3 r! p2 X) b
** Set the serializers, Currently only one serializer is set as. a& T6 V; i3 M% {; |2 t/ G
** transmitter and one serializer as receiver.
( }3 a7 ^) Q- {9 q*/) x) T- _& V5 F/ b- o
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);0 Z' l3 f! A+ q; R
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*# e$ {: y2 }) Y( F2 }" ]
** Configure the McASP pins
, Z! F- b  C1 F6 T3 O** Input - Frame Sync, Clock and Serializer Rx: P( S+ C/ N' f3 Q
** Output - Serializer Tx is connected to the input of the codec " {, _; t  L" b6 U
*/: Q" g/ X3 H2 s5 ]
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
6 B% ~$ {$ T4 P$ v8 ~McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
# A/ ^- c0 M( Y) F  YMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX! q( x6 T2 P- _- Z: a. _
| MCASP_PIN_ACLKX
# \# ^$ r; b* m4 e: y| MCASP_PIN_AHCLKX
% y1 Z& Y, q; m$ e7 N; i+ S| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
2 I! y, [' h$ hMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
  g9 W, \6 |4 P# F. v| MCASP_TX_CLKFAIL
. ~: k" U3 p, `| MCASP_TX_SYNCERROR
1 m; n! F% e- H| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
/ E# p' w; \" [: Q/ {3 Z6 k| MCASP_RX_CLKFAIL; k( a9 A. d$ ~! Z# I2 t
| MCASP_RX_SYNCERROR : C: [7 W0 u3 d. q4 L
| MCASP_RX_OVERRUN);5 w' _$ V/ E4 U4 p
}
static void I2SDataTxRxActivate(void)
! l* V" W, R7 |! N3 I$ w. f; b5 O{
1 D* h' q2 J7 a/ Q. z3 {/* Start the clocks */
& D& s) e: x, S- ^; P* X# aMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
1 H1 C/ K/ a* W$ j% jMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
; Z6 Q7 R6 S7 J5 _7 OEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
. L; C; z9 A# t. REDMA3_TRIG_MODE_EVENT);6 y1 z* l- ~( V8 K: c
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, " w2 y. N: a9 Z: c# i
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */* l+ |% t: M; C7 L! G+ n! M- d
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
3 s& V+ C. s! o0 C* K* e3 OMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */: x* C" \5 J9 _
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
7 {; t$ b. ~1 l. lMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);) u" l; v! v+ ~6 U: s$ L& s
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
" y: G7 h4 Q  T; L# p}
5 i# r. m" J" B
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

$ a" E& v1 I* @& Y  ~
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