MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |正序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,6 V6 l: ]% m1 V
input mcasp_ahclkx,
! C5 p$ R! Y( v2 _- u3 u9 W# o9 \input mcasp_aclkx,6 C: r( X* w5 V' I2 j
input axr0,/ ]) r5 r; V5 H
0 E- ]! z2 x5 U5 [
output mcasp_afsr,
, J+ m% [- y: h% \7 y0 Y% woutput mcasp_ahclkr,1 Q2 g9 J% S3 }
output mcasp_aclkr,9 z6 j! g* _2 Z' i* o1 C
output axr1,3 w% v2 ]0 l" _  {+ Y2 e/ [
assign mcasp_afsr = mcasp_afsx;2 F2 n$ i7 Z0 I6 f1 h) K. R
assign mcasp_aclkr = mcasp_aclkx;/ o1 Z! I( ^0 I! I' p6 u
assign mcasp_ahclkr = mcasp_ahclkx;
5 o0 _  a1 q3 ]9 r8 jassign axr1 = axr0;
' Z/ x9 o9 A2 x. z+ l

# y0 Y5 {& K% j4 H$ I! c
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
  D$ o+ m' t5 b9 B- q1 y( x
static void McASPI2SConfigure(void)) S7 I+ n8 {+ q$ z4 N* J( U) A! ^' j
{
* H$ Q4 }1 ?9 G% [McASPRxReset(SOC_MCASP_0_CTRL_REGS);% {* A3 ]1 K9 J7 @" F1 w! ?
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */+ H+ h% N$ {$ U8 f
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
: n4 |, `7 g/ j- }# fMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
/ ^2 [+ Y( N4 H- n  DMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, X# H- t- B$ D; k4 I, Z9 o. @- PMCASP_RX_MODE_DMA);. u1 ?$ l, a/ G1 |- {6 e
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
* z! X; G, G- c7 {( ?+ }MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 \; q' t# y) k3 Q+ Z
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, " M6 M) w0 d7 d9 t& s% F
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);+ y, p3 Z. @/ F- ]: m) f
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
( U8 \) D1 |6 S1 CMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */. H7 ]# @% o+ T/ M! J  I9 e- Q
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);. A/ z) R9 N8 R# o+ }
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
, W4 U  v  D3 ^- \2 WMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,- O  R' N7 ]; M3 g% Q
0x00, 0xFF);
/* configure the clock for transmitter */  I' J- P& {0 L4 y* `/ G5 }$ b: I% O0 Q/ y
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
" I" s  M2 b' u$ ]; U( }McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
9 s! `) x8 o; O+ DMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,; L( [' T3 M8 U& T/ g
0x00, 0xFF);8 \/ {3 j7 }' Z$ ~' x; U
8 `/ v- s5 I; a: D# I8 `3 }
/* Enable synchronization of RX and TX sections */ , F2 F4 w1 f/ e
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */4 V& V" }( _3 U" I3 r( e
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);! V. F; i- g+ x. Q; s) N
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
& q% z+ p; s/ p4 `** Set the serializers, Currently only one serializer is set as
" b$ U) L6 s; {7 _4 ?0 n- Y3 h) N** transmitter and one serializer as receiver.4 `" r) L2 _9 U2 _% P! S
*/
! K* _/ r* J0 ]: ?6 V- DMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
0 d' s' |2 H0 [3 x0 l7 A* JMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*2 d: }# [0 r6 O. b
** Configure the McASP pins " [. L* N: z+ n: `5 Y
** Input - Frame Sync, Clock and Serializer Rx
9 ~% p4 }$ t/ T3 O** Output - Serializer Tx is connected to the input of the codec + K& l4 i! D' P- Z8 x0 ?# L
*/3 P$ Y$ T  r; P/ x: V# c' |
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
) t. l* P1 o$ cMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
. z3 ]. r7 t; LMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
0 _/ L2 q2 {: u| MCASP_PIN_ACLKX
5 [  q: T8 D  T& O5 {| MCASP_PIN_AHCLKX9 ~5 t, h  \+ _% g7 A
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
* L0 o+ d5 M) M0 ~3 SMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
- W; r" I5 H( y% l1 S+ m| MCASP_TX_CLKFAIL
+ i9 w4 k: {- F! O| MCASP_TX_SYNCERROR2 C/ {+ O' e$ B# [/ m
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 0 t+ J  _* k$ E  Q6 @7 X" B5 \
| MCASP_RX_CLKFAIL+ O5 b" F1 ?3 j  S$ A  z5 G/ V. w( B4 c
| MCASP_RX_SYNCERROR 5 r6 O4 O8 `( n) y- ?
| MCASP_RX_OVERRUN);  m6 p9 y6 O3 N$ y/ P
}
static void I2SDataTxRxActivate(void)* T1 s1 E# p/ d. w5 e& H4 K4 A3 M
{1 P' ?; X2 p2 S8 E- g
/* Start the clocks */5 P- h& k3 Q+ {/ h, K: k! T7 a
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);( k. p+ g" r9 {5 w
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */9 y/ n2 |& t+ m: ~6 K
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
* M# h2 d7 c/ {" Z' fEDMA3_TRIG_MODE_EVENT);4 D) R# r; x/ x4 E$ G- g# ~
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
. [5 Y/ N* v5 r, A  t6 |) Y! T8 {EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */3 n! B3 v/ {% L* Z% A
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
) t* i/ O- e9 c% U+ h, CMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */1 Q( c+ Z; W( |6 d. K
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */2 Y% A6 K  ?; q/ ]9 s! k. T) m6 w
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);7 J1 ]* d+ x( a9 `7 L8 Q7 }
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
8 e3 j! m+ i7 ^) T  N}

# Q- @' c: L5 s; {0 N, r
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
5 ~; l8 Z; a0 ]$ [* @6 G$ G
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