MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,/ K" o1 J) t: G# j0 o7 X* ]) \
input mcasp_ahclkx,
8 h5 \& d7 t* Hinput mcasp_aclkx,
- }9 E& h) ?/ e( Y; \. \input axr0,* c" R5 I% I6 i( e1 m5 S/ g  L: H

# U5 I. h: u/ ]( c% Boutput mcasp_afsr,# h+ O" k0 A3 Y6 F. V
output mcasp_ahclkr,
) A3 e% V( ]! p! \/ i1 g6 Z; T" boutput mcasp_aclkr,1 a; p8 R7 V$ W" G" _- g* C
output axr1,
, q2 K6 `! _$ p
assign mcasp_afsr = mcasp_afsx;
8 i& v! B7 v+ |/ C5 ~9 x4 t8 n- Qassign mcasp_aclkr = mcasp_aclkx;; |. H: I0 ?3 _& O0 E
assign mcasp_ahclkr = mcasp_ahclkx;
# r9 i* O. _0 `( j4 g0 f7 J" tassign axr1 = axr0;

2 {# e; C3 k7 a; h  o& k$ ?# ^3 b* I) q$ X4 F
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
& I- L4 g& i( Y# z  j3 e- `$ A2 h
static void McASPI2SConfigure(void)! Z. x7 V" D: }5 o. k
{
# Q0 [; i) ^0 |  J. HMcASPRxReset(SOC_MCASP_0_CTRL_REGS);4 C* K8 L* k: [+ m7 @( y
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */1 \9 J1 H6 a0 f  k# C# w2 ?, I& ~: `/ D
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);' U! c) \0 V. z0 j6 @* x
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units *// h6 h! r) f% R# |- p$ Z" t. D
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, o( D4 c/ `: i5 s8 O4 B; n( M6 d; qMCASP_RX_MODE_DMA);$ H% q" l+ t, W' T6 V9 _
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,3 i3 y. l+ ?# W1 A' z% `2 {+ b  H
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */$ z0 s0 Q: y+ n+ v0 h3 _
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, * f: M3 a; i" ]( u- U/ K0 T/ ^
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
: y6 x7 Y. h9 c8 N& gMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
  V4 u$ q0 P: s' R7 mMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */5 f& [. c# {5 L7 E& P
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
+ g0 B% F2 p  B5 O# YMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 6 C- Q4 q7 _- x" e8 K
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,1 k+ k) X$ Z! n  E1 p" Q. k+ ]7 J
0x00, 0xFF);
/* configure the clock for transmitter */% d, M+ p+ L, p, ~& _5 M. Q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);) M  ^0 \$ h: Z: t
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
* I$ {* U+ u0 eMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
) u2 |- @$ C/ ~' g0x00, 0xFF);0 a! i* F* v5 ^4 M! b1 I1 T
2 G$ Z5 |2 u, h! _' c  L
/* Enable synchronization of RX and TX sections */
5 G6 f/ s1 w7 E- z5 GMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */% Y' O/ h5 r! [5 U
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);0 [3 b2 U8 s+ t
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
) A6 f2 {, C3 Z2 c2 X. S6 N) A** Set the serializers, Currently only one serializer is set as) |$ e8 z2 D! z
** transmitter and one serializer as receiver.  d5 o) k( F4 ?. \/ B
*/) M; ?# [& X& ~1 O
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);' r7 N$ c1 o( Z! a  e
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*. H: `" }% S. a& g6 m
** Configure the McASP pins
0 x4 @, E+ ^/ A+ h9 J! A7 H; g** Input - Frame Sync, Clock and Serializer Rx# }8 A" K. o9 H" g
** Output - Serializer Tx is connected to the input of the codec
9 d) B  e- r% Z*/
! v5 M4 R% J1 d8 [% t8 NMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);" r: e$ n1 }/ W/ i
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));2 V) g8 T& W/ R- p7 V! t7 K8 h7 P$ G
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX2 A2 `! ^" J) _5 Q5 X3 ^, O
| MCASP_PIN_ACLKX
4 @9 B$ z1 @7 `! \' k) t  b- z; |1 k| MCASP_PIN_AHCLKX. M# t/ T- y5 L5 s5 J3 G
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */' U: `3 n3 p/ ]2 s  x. F$ ?5 G
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
+ V9 ~) N- {! s. ~9 W  M% L$ z| MCASP_TX_CLKFAIL ( {7 x; M8 s" F& L& E# z7 ~& j
| MCASP_TX_SYNCERROR
; J0 A) J" H9 X9 X% y| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ; r, B% ^# [" b( X0 A! _
| MCASP_RX_CLKFAIL
$ s' n, c- g& M" \- h2 `| MCASP_RX_SYNCERROR 8 L) d8 z+ R; @+ Z: A0 i5 t% H
| MCASP_RX_OVERRUN);
& \) h+ A7 q" x' k0 h- D& m}
static void I2SDataTxRxActivate(void)
* }; f& }; J' n% C5 R{6 w, S! [1 l3 X+ @, O; \1 J2 i* i
/* Start the clocks */& Z% q/ n9 G: f- Y/ E$ N
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
0 D1 t" Y' K: H1 i& R4 W  QMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
) ~  W7 y! z4 v" ?* qEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
# e' {6 d0 C2 v! Z. hEDMA3_TRIG_MODE_EVENT);) ]3 A- X/ _( A5 r
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
1 G. d7 f/ ~' j& AEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
/ ], R5 V2 O/ ]/ KMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);4 {& H; |1 t( v; |
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
5 R" @, H$ V6 C8 G6 [while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
! c$ s3 K3 i# p. R/ N* W/ V( G/ ~- ?McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
0 x+ q+ q4 j' c9 a/ _1 zMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);8 j1 G% v# f# ?' W* I" ^4 w
}
( o% \- y2 ^4 l2 ]6 d
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
: M0 y' M8 z) p( D
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