MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,3 J  `) J0 S+ x6 |- E5 u
input mcasp_ahclkx,
9 Z4 Q1 y. h8 O! k3 Hinput mcasp_aclkx,
+ r2 C, r- v5 M4 d! e8 @/ E- tinput axr0,
! L, c+ z, v  I/ z
5 e* `# {9 o7 R# z2 foutput mcasp_afsr,
5 j/ g9 `$ ~0 @7 toutput mcasp_ahclkr,
% r) K/ F: c6 r/ ~2 ?output mcasp_aclkr,0 m! ?9 V3 Y' f+ ]1 C4 C( e
output axr1,! a$ ]+ q  D8 i7 F; u5 M) [/ U0 K
assign mcasp_afsr = mcasp_afsx;8 G/ P3 @8 j9 |( u0 d; F* S
assign mcasp_aclkr = mcasp_aclkx;
$ r( W4 A& t9 a$ Massign mcasp_ahclkr = mcasp_ahclkx;
' u: |; a, n, B$ b& ~assign axr1 = axr0;

2 d: Z; g5 \8 d7 m' R  d/ p( C+ w; n$ {7 w& a, K
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

2 {7 O" T3 L- c5 h
static void McASPI2SConfigure(void)
& x  x1 F: L2 h9 V4 D' O{- o4 m/ D* k, q: T# H7 C
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
) S/ ^& S8 I' C2 ^1 DMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
/ {/ j/ F$ h4 ^+ c) o, Y- tMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
* i4 {- Z4 O" t$ u; ^0 y/ T" o. [McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */+ g( i2 q5 m- e+ D  |
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  \  a7 N* O4 a* Q/ H4 |) M
MCASP_RX_MODE_DMA);
2 d9 T( ~0 ?$ Z/ t$ @McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
6 U8 r. O& v5 }2 yMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
4 o# P/ u5 i6 O! x* D, g3 s6 vMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 5 W8 Z6 I* a. x* t) ?
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
. {1 K+ m8 X! M% L' ], \; \: I4 @( cMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, ! G+ S& Z' d  C! }4 W6 Z1 q2 n
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */9 @4 y: R8 I5 `8 s8 `  R8 M  I- @' O% C
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
& i6 Y* w% C$ R2 W- ^McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
2 o8 @% \# z; t! `# A0 L4 Y# nMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
: p! t$ ?/ D1 R- ^) g+ j1 p5 C0x00, 0xFF);
/* configure the clock for transmitter */
/ n( m1 s! N. n9 @. f* ?McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);3 {( m4 s* J: y7 x* `
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
7 d( P2 V/ @; D: u$ YMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,! g  g0 w2 M6 M, Z7 y
0x00, 0xFF);: N  Z: n$ _3 v$ S3 {

) E4 k7 j1 z0 L& {: ^/* Enable synchronization of RX and TX sections */ & q3 T' X& z, }( n5 Z& D5 ]
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */( X* \2 J: ?& l( ^
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);" D  q5 a1 G9 i- _. I
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*: G' d1 y* e/ H
** Set the serializers, Currently only one serializer is set as0 t3 }( [* P% ~1 U  U- Q5 k+ X
** transmitter and one serializer as receiver.. A  d- I7 F  A* }
*/
6 h4 V5 {, ?5 fMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
+ r, h( A  N' R# ]; T& y# I0 w. k5 yMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*6 L, q% o& \4 v4 t' d& K* E3 u6 f
** Configure the McASP pins 3 \3 w! l" b5 K: N
** Input - Frame Sync, Clock and Serializer Rx/ H3 s$ I/ g4 y1 |5 P  {' q2 ?( G
** Output - Serializer Tx is connected to the input of the codec 2 J$ l* K3 E, }: B" M- E, {8 a' V
*/. a5 \( {! T  E9 F3 o$ x4 [# `# k4 P
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);6 }8 E! a* @% A& T( o3 d* f
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));' {6 X: x4 }* b" R% {
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX0 G- B/ Z. U1 b' S
| MCASP_PIN_ACLKX5 e& S! Q1 ?( J% {7 I
| MCASP_PIN_AHCLKX) K$ e* V4 @/ i; a
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */( [/ G0 |& u8 F4 L1 H- g5 B8 N
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ( j0 g5 O! M# u* d
| MCASP_TX_CLKFAIL 8 q( X1 ~1 L9 b4 ?, ^- z
| MCASP_TX_SYNCERROR
0 {6 ~: a+ w' }% P& n5 S| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
- u* d9 W7 t$ t5 h5 q# U| MCASP_RX_CLKFAIL3 R9 D, k+ m8 G  Z& J
| MCASP_RX_SYNCERROR   P; ?& o8 F0 V5 h! T
| MCASP_RX_OVERRUN);) ?; k% i9 P# i6 z# f, G
}
static void I2SDataTxRxActivate(void)6 l5 E! ~% `8 {
{! t2 ?4 L# A; z; R% R7 z: s
/* Start the clocks */
4 W9 l3 o* U) ^. N0 UMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
% i: i+ Q3 i  iMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
9 q- f, g8 f  z* y0 z. J2 C9 }EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,: s8 A1 _$ ^8 {: F; E5 }0 D
EDMA3_TRIG_MODE_EVENT);- E' P+ g: b! Q. r8 O8 y4 [
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
  [  f: c& k4 Z( s- ^EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
1 S; d( I9 j( S. BMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);0 g; n* r. e2 d1 j; d* z
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */5 z  p$ H. S1 D# }* @6 V( g: S
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */+ a! W: Z: F3 U9 p: k; f
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);  \0 Q9 w9 u) H- ?: B/ S. r
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
! d* T1 ^% o6 D5 q7 q+ `}
4 E: J* C1 f. n& X
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
! ~+ h  ~% {+ M; A# e
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