MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
$ Y: c) |3 h$ K+ N8 s* _input mcasp_ahclkx,3 V" L$ ^1 u  P3 Y1 d* c5 _
input mcasp_aclkx,% e0 T0 I6 z- s" K& A% `" q
input axr0,. h2 ?5 t4 p+ I# A) d' Y: }
+ E# g" I5 t9 P; f) b- x" @
output mcasp_afsr,
3 i6 ~  J/ L) g8 }0 routput mcasp_ahclkr,+ ]5 P1 n/ }0 W+ f$ v8 C" v
output mcasp_aclkr,
' h+ h% S$ {, b, f  ]1 n6 Boutput axr1," j& y6 j3 N9 T# u: A5 o9 l! u8 l2 N
assign mcasp_afsr = mcasp_afsx;( e3 _: l% Z% I1 _/ z5 m" N
assign mcasp_aclkr = mcasp_aclkx;
; T# I4 T1 |# Tassign mcasp_ahclkr = mcasp_ahclkx;
+ h2 q. i' e' s. k& Uassign axr1 = axr0;

9 b; Z# K0 l# t7 P- d/ `2 m5 i# U& {5 `
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
8 G/ z7 G% \( n: N, R" G, e
static void McASPI2SConfigure(void)7 `6 m! O% L4 p2 S
{! o8 `* C9 K0 F4 X+ A3 ^$ d4 F% G; z
McASPRxReset(SOC_MCASP_0_CTRL_REGS);3 a/ _  k. [$ {+ m
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
; L5 S* Z, H5 _+ E# V* x& SMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
% e3 ?# `, l7 h. Q& ?McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */# C0 N6 F+ ^) I) K" |* X
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
: s/ M6 M; n) q9 z& n6 OMCASP_RX_MODE_DMA);1 n8 E  R$ ]* T% X. O& S* v7 d
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,3 _$ k- T7 _  p$ [# x1 X4 p
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */7 A5 a) }1 ?; u1 a# S
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, $ s% `( M3 [$ q
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
. I8 [' `0 ]' M4 n8 E1 E& M6 BMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, , C- R% K. ~* X) j3 n
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */5 t# X& k  Y* w- D! N
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);" D$ [4 d- g% s+ E- R+ w
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
4 O) \0 u  o* C6 C* ^. |9 MMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,! j0 H3 L! t/ f3 p
0x00, 0xFF);
/* configure the clock for transmitter */
1 Z- f) Q: c1 \; x# ]# O0 G  [* D  L7 tMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
9 L$ n( C$ ~- M* ]$ C: F7 aMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
' e; ^6 J- e7 G7 d+ V4 XMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
0 A7 V$ L, p! |- q5 v- e6 }3 d. M0x00, 0xFF);8 c* i' i4 e$ p8 q- m) Z8 g' g8 Q
; [* W* _0 J$ q( w3 i$ z
/* Enable synchronization of RX and TX sections */
4 M. F: Z0 y/ x: Z8 x$ E2 kMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */2 c; P- V+ w/ G$ J  g) ]
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);: B9 O( n  P2 m, H. N7 {
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*; J' ]% D$ l3 n. `! l0 q" j
** Set the serializers, Currently only one serializer is set as1 K, |  Z+ T( l" r
** transmitter and one serializer as receiver.. b$ m2 }9 a- `' ?
*/) b; A: b* {7 ]2 e7 G5 }
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);: I+ }" v! m5 W) W1 w
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*. B* K" e# ?0 {; p  Y
** Configure the McASP pins
  m, O- o# \0 t+ K+ ]8 L% ~: \1 M' V* b** Input - Frame Sync, Clock and Serializer Rx! e0 u+ ?, }, a  [  f/ b+ M0 L
** Output - Serializer Tx is connected to the input of the codec
  c8 c5 ]' A/ P. O*/  d" T' Z2 X0 S$ K, n
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);9 V, F' Y* G  \. e' t: }
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
4 L/ k0 V4 L0 g7 b. X2 bMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
$ F% @+ P4 v7 w' a| MCASP_PIN_ACLKX- f3 R3 Y( l2 {) c
| MCASP_PIN_AHCLKX
( J7 f1 B; s1 D$ B" C, }| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */' F# z$ p9 X0 I$ M  s. q
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR / [4 ?5 j  {' i0 g. ]+ O
| MCASP_TX_CLKFAIL ' g/ C$ H5 [) W. Y9 a8 T
| MCASP_TX_SYNCERROR) ~9 a3 C2 S$ a
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 5 F6 x* O2 i) Z' e( t' u8 _
| MCASP_RX_CLKFAIL- o6 l0 _) W: i
| MCASP_RX_SYNCERROR % l: ^& E+ t5 [
| MCASP_RX_OVERRUN);
: F$ t2 g% o( r3 u: T8 f}
static void I2SDataTxRxActivate(void)  I' i& C) ?: p* O$ z/ B& @
{* v6 Q" C  V4 n4 o
/* Start the clocks */
4 ~/ c+ R! u# @2 S1 rMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);8 f* i6 y" Z4 j
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
: t3 H4 O2 K- S' o- c9 X. E7 h9 QEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
! j6 b3 e. z# \! J" g$ R1 REDMA3_TRIG_MODE_EVENT);
7 j0 _, F/ B7 J. i, CEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
: Z' F6 Q  Z' W+ YEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers *// ]4 u$ F) w4 m, e& E
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
$ ?' q& B# `; e( c! ~McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */8 w" J9 Q2 o  ^" ^0 J: f& f  t# |' |
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */: U# N, x8 k8 A* e' i' v, C  x2 ~
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
$ Z9 K) S! l8 e. t; YMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
6 N* N0 [0 x5 O! S5 A}
4 A) W0 B3 p$ u/ m4 A
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

) A8 i, B8 ?' h# p
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