MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,1 j5 `6 D3 k* M4 Z. Q; N& K
input mcasp_ahclkx,$ R7 ?* ~( \3 l" r; i- A
input mcasp_aclkx,. M) D! c: `8 D) w7 f  N3 B
input axr0,
  \; n/ g, _% A6 j
) w  h$ S( w/ V9 Uoutput mcasp_afsr,( u, k9 d$ a2 ~. W7 q! U/ Q* B
output mcasp_ahclkr,7 ^  t) B0 H0 I- G3 w- @
output mcasp_aclkr,% D, m7 V# y& P! j' |8 w
output axr1,
/ U- g1 Q5 M7 i- O+ Y
assign mcasp_afsr = mcasp_afsx;# Y; b) F* D+ |9 U4 u
assign mcasp_aclkr = mcasp_aclkx;
  a& V& H6 \2 [" G9 Q- lassign mcasp_ahclkr = mcasp_ahclkx;) U$ ^" A) `9 h  t! v- j5 Q
assign axr1 = axr0;
% e/ o. }) }  `: d

4 S- N; t; a/ D! X4 a8 N0 K
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
8 W. Y" k; I' H; l0 U
static void McASPI2SConfigure(void)& m4 K) T9 G4 `2 q! t: Y
{. G. j' y1 N8 K& S5 J. }1 Z
McASPRxReset(SOC_MCASP_0_CTRL_REGS);( L- M  w$ j4 A( Z
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */" l( p4 w7 {! w1 s/ G- |1 B
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);5 }0 X  k/ t! ^4 d7 z* i
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
5 o$ e7 G0 g6 P3 O7 D" ?* Y7 GMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
, d# Z% R. B( k. ^/ z- JMCASP_RX_MODE_DMA);
% d4 ?* t3 E6 k( CMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,( `/ s4 _; x1 S
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
, f% x; f6 \% GMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
  i. x0 P* d! m' r% yMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);  `' P/ ^! u" h7 H: i& A
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
. z" Z3 j0 Z- b8 eMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */7 y8 o2 \" B% }/ o2 d
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);4 z" u- e. `/ Q
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
# e$ d) K& f- O: L1 a# |# QMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,& I2 e: S8 H0 E
0x00, 0xFF);
/* configure the clock for transmitter */
4 |- u! Q* W+ v1 BMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
8 O2 J- H' ]  f+ a3 |McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
! b2 S6 |; o) b3 R! K$ H8 YMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,- f, l8 X1 @! [5 S
0x00, 0xFF);: F# s; `8 r9 z( R5 w, }
* i0 F$ _* t& c" J7 u) v  P
/* Enable synchronization of RX and TX sections */
) @. B, J. I3 ^9 F3 YMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */9 v. i6 v3 A2 P/ h2 A  W6 ^0 p" z
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);2 ~" I0 A0 w. G
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*7 x* K$ t+ w: ?( B8 U: ?& a& u
** Set the serializers, Currently only one serializer is set as
: g& l3 P. V. k** transmitter and one serializer as receiver.- [: l# m9 g, e. i9 Q: J0 f
*/
9 t& }( ?0 B3 r7 _: p8 i& j$ [McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
6 L. r; B+ c3 HMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
2 k7 D3 e$ x+ p8 J! m% d7 N** Configure the McASP pins
9 }% g: p1 m1 P6 C; P4 v0 U** Input - Frame Sync, Clock and Serializer Rx) d2 q. O0 A5 \! `% I( h8 p8 C
** Output - Serializer Tx is connected to the input of the codec
) P4 Z- z2 N( H$ y5 j" M2 B; Z*/
3 t7 M9 \  p. G; v8 f$ o2 _McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);5 G8 Q$ X6 B$ v% V0 E
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));# v2 n, b/ ]9 ^# c* }( v
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX3 L" c) Z2 k: ~, S8 d
| MCASP_PIN_ACLKX
) Y- o( g, q5 U7 ?1 o+ `7 b| MCASP_PIN_AHCLKX5 t* r: f) I# C4 L
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */: X9 B  `9 E$ Q* U" I) T0 c/ w) l8 O
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR * H4 D* m- D( \* b4 q8 `5 z4 a
| MCASP_TX_CLKFAIL
! O4 R: N+ h; r/ r! B, a| MCASP_TX_SYNCERROR0 T' d. B+ O' C
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR ) o" Z9 q) s5 y
| MCASP_RX_CLKFAIL
" g5 t. o7 L& O5 _; X3 c: Y| MCASP_RX_SYNCERROR " O4 c" N" s7 B# k
| MCASP_RX_OVERRUN);
3 P/ O( |' ^9 u; W* y7 Q4 `4 F}
static void I2SDataTxRxActivate(void)
' e7 y$ i+ {' A6 @0 d{& J& j, c8 I7 v& G
/* Start the clocks */% L/ l/ Y+ N) d; H1 Z
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);; O8 h3 H0 m$ j: p# U" N- H% P% N
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */& x6 o0 g& s$ p/ o! z! }
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
7 a4 |" q3 m5 W/ uEDMA3_TRIG_MODE_EVENT);1 ^7 W  |5 I, Y
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
+ _$ E! \8 c) a  p( B% c7 ~EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */# P# {: e% A& A$ s9 Y9 M
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);1 q+ ]1 R7 m: L: a2 y
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
; J9 S1 s* l  v- Owhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
/ b& A7 q1 j4 N, [4 P" h2 lMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);5 V1 [) ?( N2 o5 r# M
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);# r& R+ J! J% F
}
6 t% J4 d% c3 R! ?7 J1 N. b. L
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
$ J- e9 I4 D7 f) G0 u' p; w
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