MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,. r3 d/ c* |+ S! m  {( L
input mcasp_ahclkx,
3 b& F- `& D2 R! ninput mcasp_aclkx,' f0 _& [& J- y" G
input axr0,+ p0 C) Q6 R: H+ G. W
% B, i  c- g# D& o7 h
output mcasp_afsr,
4 k. e+ y2 c. m! Houtput mcasp_ahclkr,
. R7 s# r' b8 {: O' Eoutput mcasp_aclkr,
! I- j3 B4 H, W# p" l/ woutput axr1,
0 U! V% s* L, h6 W& V
assign mcasp_afsr = mcasp_afsx;9 @+ n8 p- Y/ e  G  `7 G
assign mcasp_aclkr = mcasp_aclkx;  L1 D: I& W$ t
assign mcasp_ahclkr = mcasp_ahclkx;
2 y2 w% B" W( Oassign axr1 = axr0;
6 K) ^4 i: e4 d/ K" n- m

& i" d# y) n# W0 t5 ~
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

- T& N! |4 J: Z" I
static void McASPI2SConfigure(void)8 v$ a: H* [0 v2 ?9 h; T
{
3 w, W, b8 r( A3 S" BMcASPRxReset(SOC_MCASP_0_CTRL_REGS);2 H2 A3 E$ l9 j8 J, w
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
1 h& @. C% {& CMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
8 F$ S* ]+ W6 o& p  b/ G3 Y/ OMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
( G3 h5 D- k; Y* g2 l9 eMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' V3 A! }/ {% b$ X
MCASP_RX_MODE_DMA);
6 j0 R( M" q  x% a2 d& C5 `McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
/ g0 }/ i( d" k$ p' x5 v; j" D) U' U7 jMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 n7 A! B: Y3 D, j' n% ^* S
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
% k, Q$ R9 d8 M5 b# f; VMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);1 f3 K( _0 X# @" ~% D8 C* S. r
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 4 p& v4 |* p& x8 {# O% T
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */- \( `8 y$ W% q& C0 E/ M
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
) I4 p/ u5 Q% O" P4 I# X3 J# ]McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
# ~9 `" N1 |+ @; y8 [  m2 S( a/ K' eMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,( g5 z& y7 J. f
0x00, 0xFF);
/* configure the clock for transmitter */9 V8 d& ?) p# i* m: f2 `( t
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
' L5 I8 Y9 C. _' ~2 D' wMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
/ h* c% h, e* y5 X  w$ B7 @) GMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,6 m4 F1 d& X3 s7 u5 ^  B
0x00, 0xFF);4 U: a1 g. s3 Q  m5 j

! ^* T" I, }5 Q/* Enable synchronization of RX and TX sections */
8 d( L" R" M* \* |$ BMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */* w) w, I5 x; Y! h# u7 J( d
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
5 K( |! x6 Z; Y, ~McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
6 Q$ G* ^8 x( P. [** Set the serializers, Currently only one serializer is set as
6 D5 D" }" p; T. k" X/ }. q** transmitter and one serializer as receiver.
& @* K1 @  J- r, m' S2 f' z*/; Y+ H. Q2 @% q$ l1 z
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
; F: Q/ a6 b* Q& O' a; u5 ?McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*. X% }* h+ b3 E1 l  K% w) w
** Configure the McASP pins % H3 t0 A+ L  p7 [
** Input - Frame Sync, Clock and Serializer Rx# S  [; g8 y0 R! I* _2 S9 B9 `+ h
** Output - Serializer Tx is connected to the input of the codec ' ]0 t7 G& K; `# w1 ?
*/
! R& I  S( G. ^4 K/ sMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
" Y' z& {* i( g$ FMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));" C  k# A2 v* }  D* S
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
2 p3 M: D% V6 z1 ?3 y) J. }| MCASP_PIN_ACLKX
/ b' e' ], y: L" V| MCASP_PIN_AHCLKX
3 S3 d0 {: m9 A| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
& ?5 d4 F% {9 e# y, w9 D  HMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
) Y% O. C! ~$ ]  \; l/ Y# x| MCASP_TX_CLKFAIL
/ K! a+ {+ k( G3 v( M8 [| MCASP_TX_SYNCERROR: _. J- f( s9 |3 p3 s5 K
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR 0 u. b; x+ u3 V$ w
| MCASP_RX_CLKFAIL
6 j2 D8 t8 M/ S* L4 w| MCASP_RX_SYNCERROR + L7 O1 o- t/ S) o  X- f; U
| MCASP_RX_OVERRUN);
( x8 l; p5 P; m( k5 \" J$ \3 w}
static void I2SDataTxRxActivate(void)8 }: E  i9 C( g6 e: v9 V
{
8 @1 E% j7 e. }( h/* Start the clocks */2 ]8 v1 P5 }9 M
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
5 T  p, m" v6 e; _1 b8 LMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */! f) _8 F6 V" p; T) E
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,* e& t( T. k+ N
EDMA3_TRIG_MODE_EVENT);
8 X1 r; J) n0 p2 d7 u7 p2 UEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, # j; y  x: f/ I& C! T, V# {) K, x
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */! A: X( M# k0 O! k& U* g* R
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);+ Q+ J2 R. A! ~. A$ X1 I
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */3 w, M, a; y$ D, Z/ `5 y
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
( u% E# F( S2 K: gMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
; Z! j, l. z; J/ C2 I* aMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
7 E: q( j+ D: L% |& \1 R}

1 P. k' i, n7 H6 g
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
9 R8 d8 H9 W) \4 Y% x: g' m/ [
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