MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,' \6 p: e0 E: _1 P' L" J
input mcasp_ahclkx,
" M3 _9 _1 y9 ]$ minput mcasp_aclkx,
* a0 R* h+ U; Xinput axr0,+ f% w/ r  H% y

7 v8 e3 C" N$ G- Moutput mcasp_afsr,8 E. a% L. R/ _7 [7 R
output mcasp_ahclkr,. L* N2 f7 D3 g
output mcasp_aclkr,3 \1 I, U6 V7 ~6 g
output axr1,( R. D5 E5 q+ D3 z* r  G! X& `
assign mcasp_afsr = mcasp_afsx;
$ ^2 I8 L7 F: d$ L7 \- xassign mcasp_aclkr = mcasp_aclkx;7 g* l: K0 t+ _+ q
assign mcasp_ahclkr = mcasp_ahclkx;
* g' u2 i; m- G: ^0 R0 M& ?assign axr1 = axr0;
9 z6 R$ ?9 P8 H1 }1 Y1 F

+ }/ A  |) x8 M4 A; h/ L
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

) B( T# j( c2 k* P' @4 ?
static void McASPI2SConfigure(void)5 @" E) Q* v' ^1 C/ ?" w7 o
{2 A$ j: x, M- U" m3 `
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
3 s: C" u4 I9 jMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
4 X+ R0 n* K  _/ J% b5 ]5 WMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);$ v$ y; N$ O; a0 q- k
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */; w8 l2 N/ X9 M7 \+ i: a
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
0 ^" {  M- P& FMCASP_RX_MODE_DMA);
1 {- |3 l4 `3 W( ZMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* K9 @5 c, _! C# u# m3 P0 U6 u' A
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
- N4 K9 t7 B8 [* p( _7 {McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, % l! r$ t9 t5 E9 W; m
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);0 B5 k( _5 |& l% P) }) u
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
# x, n* m3 O" {" ^/ P: u9 T0 HMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
6 o/ r( {" t6 h* r3 vMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
, A" r$ [/ K: I! Z/ x% P$ w) yMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
5 f: ?! a+ v" Q% aMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,9 b. V  h- I& j# B% c) n
0x00, 0xFF);
/* configure the clock for transmitter */
$ D! |% |, H. v5 t4 F; uMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
, {3 I* w& ?' a5 zMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); - O2 P& \5 p2 `' V" u' H
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
3 g1 A, v2 \3 f" ^" K6 m- e7 y0x00, 0xFF);
; l! ^; z$ Q" L# p* c6 |" Q* w' A5 f3 R
/* Enable synchronization of RX and TX sections */ % [* a# _& B5 g% \: F
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */% Z: I2 m" l+ @
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);* M2 C9 y$ h: n7 z$ I( i2 j; @8 ]
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*9 e( _& ~/ R4 v: @
** Set the serializers, Currently only one serializer is set as
; s" [, B" u1 N) K' m4 _** transmitter and one serializer as receiver.( \- S, v: I: k" Q9 ]
*/: d& q  D& e! C2 v: G6 n$ _! G  a
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
% A& g# V& i7 vMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*2 U3 b& R; i' D* f2 Z9 e
** Configure the McASP pins
- ]+ ?1 Y" V! Q+ d2 d1 U" O* H** Input - Frame Sync, Clock and Serializer Rx' z. u' V. Z. e
** Output - Serializer Tx is connected to the input of the codec # h" k' n# R  M: F% l& f
*/2 B, ]6 Y/ x) `( Z! P# g: Q
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
! X* T0 U% e) K+ gMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));: I9 s: V* a/ v  _' D. a. X
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX6 U9 f6 L1 W- M$ G
| MCASP_PIN_ACLKX% G% D& [$ L! z
| MCASP_PIN_AHCLKX
) s3 |. Z! q6 A) y! Y: _| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
8 h- d6 H4 y, O; V& dMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR * l7 @; ~9 P" U$ M0 d: j
| MCASP_TX_CLKFAIL . p1 g. R6 H8 A7 z1 q& x0 s
| MCASP_TX_SYNCERROR
2 y3 H5 _- S3 d) X1 u' ]! S( Q| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
/ |% f) i" r+ M- R+ K/ p: y| MCASP_RX_CLKFAIL3 b2 H2 o' x1 v* ?2 I7 m+ z) `
| MCASP_RX_SYNCERROR - Y; w9 k$ R" w" N( g8 ]4 A5 G
| MCASP_RX_OVERRUN);
' V8 D+ z: L9 v' t: ^" Q}
static void I2SDataTxRxActivate(void)
1 u: K/ i" P' q{
* s* D/ p3 ?1 K& E6 H, L/* Start the clocks */
( u& P9 u* X9 S7 OMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
' m* T' ^1 E- U( q+ ?- z4 aMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
6 k6 J# j5 m$ _7 ?/ n9 C0 ~  u& ?EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
1 e5 x+ X) }# u2 k8 k5 @EDMA3_TRIG_MODE_EVENT);
+ m7 x6 u' B' }EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 7 z/ Z2 O% n( L! B% Y
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */2 F8 `, `! z2 r7 d
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
2 \4 Y# z7 N* L- B/ A  Q, WMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
! x* ^3 O5 ^; e3 m2 i; R! O2 mwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
) N/ u1 S/ B0 s) u+ TMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
0 L" E2 r$ k' o6 c/ zMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);3 L1 {  `% _0 z
}
6 |9 J$ N8 \6 q$ a+ v  X
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

, U& h: N9 m4 Z$ S; b7 y! {( s7 @/ v0 g% K
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