MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,- D1 L4 u, b8 }; ]$ G
input mcasp_ahclkx,
% L' O6 a; F% y. |9 C" xinput mcasp_aclkx,: i' t4 T! d+ A
input axr0,
4 D: W* Y$ i' z$ B7 i2 W1 S
3 c6 m7 V4 f! K' |output mcasp_afsr,
2 ?2 C- N" \# v1 ~: Q4 {output mcasp_ahclkr,
& P( {+ x  W( Z( C& D) ~( |" Qoutput mcasp_aclkr,
! {, t) s2 v. Houtput axr1,
" F& X- A' s3 e( f) t$ ~& D
assign mcasp_afsr = mcasp_afsx;: i0 L* H& v3 }, d  m4 X
assign mcasp_aclkr = mcasp_aclkx;* u& k: F* D$ @6 h4 i# x; j; R/ H
assign mcasp_ahclkr = mcasp_ahclkx;
, G6 S$ p, A/ A6 b) oassign axr1 = axr0;

: f* E+ r5 C- `' a4 r$ B
% {1 g0 I7 V/ r1 c! X
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

2 t; D1 o; I) i0 J2 n
static void McASPI2SConfigure(void)
( m4 c' F+ U. B9 B) K{& n5 [  U; t3 c, v  ^% P! Y
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
+ x1 Y$ m5 x( @$ W+ u4 EMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */5 }; O: C* r5 A4 V- y
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
3 g! ^$ ~; A1 P* Z$ m/ Y6 v4 TMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
, G, P$ q- h# |9 T% g! `McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,7 r! a) I$ r4 m/ D3 I: n1 A7 J
MCASP_RX_MODE_DMA);( A0 `! h- P0 C( x, @' T% X- u! M, v
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
; A$ s0 A  b' |, q0 _MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */4 F4 w9 o6 q- O( i: I! d2 q
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ! B! z7 F0 Z- x1 i4 N! Y. [
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
! N( \0 t% Z6 r& ]4 W1 mMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 6 B# d1 [+ ]) l! i7 m
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
( O& w. m! t9 n3 Y+ K1 }McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
5 S7 h- i1 I! R6 f5 g7 O2 jMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 7 ]$ J8 j; \1 @6 Q! t: ?
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,, C; P6 `& n" ^- H8 L8 T6 h
0x00, 0xFF);
/* configure the clock for transmitter */( E5 X" Y; |) W+ s' J+ |* u
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
; F' ]  h* B/ @$ D% hMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); * [' [+ }# X( s9 g6 X
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
1 }- B7 S2 f* |3 b+ M7 `0x00, 0xFF);8 s! o3 y, l8 Z; R% \: b# t; X
& y0 X  f6 T$ l  A7 N
/* Enable synchronization of RX and TX sections */
3 N% r0 ]1 h0 Y7 Z- `) MMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */( ^+ F+ H6 A; Y$ \0 U3 ?1 o
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
, Z. \7 s* ~3 D4 C4 Q. ZMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*! z0 `7 S1 d- D" N' S' E
** Set the serializers, Currently only one serializer is set as: y7 L/ y' d. H! z
** transmitter and one serializer as receiver.
+ [& M$ e  v' a1 G: Y* v*/
6 d  @% m$ B& b- _; QMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);) O+ K9 K; d  N5 {
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
; R# ^' \. k6 y+ M1 f; G# z4 J** Configure the McASP pins , m$ p) T0 ~% H, f' {, q
** Input - Frame Sync, Clock and Serializer Rx4 n" v! @/ m$ v$ B6 c+ l' e7 A  r  |
** Output - Serializer Tx is connected to the input of the codec
$ E1 U; F" S& k3 z*/. i' }6 X4 k$ S6 M. X2 k( n4 e# V
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
, G) T: i+ P# d+ s4 pMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));4 _5 \& v9 ~5 k( ^$ c( t: O
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX# j4 w- B  h/ ^* V
| MCASP_PIN_ACLKX
! Y. v, B( [: ?3 v4 Z| MCASP_PIN_AHCLKX% I, a. o: E' @( V: w" R: {4 k9 R# k
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */( l: r# n1 }$ C, f
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR + T2 V$ a& t* _# z! j- O9 }
| MCASP_TX_CLKFAIL " R. M  n7 ^) V% t% ^3 B3 R; B$ n
| MCASP_TX_SYNCERROR
1 {9 ^: |. K  l' G# m, D2 e* B| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
0 |% w' N& Q: z- i) |0 L6 a| MCASP_RX_CLKFAIL
  u6 m8 ]7 B9 @| MCASP_RX_SYNCERROR   l2 k1 E4 Z8 |4 Q, u2 D
| MCASP_RX_OVERRUN);
! H" A5 A0 T* L9 a$ _8 X; t}
static void I2SDataTxRxActivate(void)
0 B& {; |8 Q- g" a' d- S  S6 l{+ G  j  C0 G  O) z+ |; B$ J4 F  k
/* Start the clocks */
0 Q8 `! `& q! b7 jMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);. H6 \; ]3 ~" Z  q8 f
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */* J( {5 }+ [/ R
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
, h8 \$ y: c7 w6 WEDMA3_TRIG_MODE_EVENT);! e; G; e8 N; W+ B( u1 ]
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 0 b% h( I. b* r4 Q0 S2 s: ~6 C
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
! {$ e! z' V8 NMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
6 Y, N5 g" i3 m& @McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */5 }- @' Y& Z$ F% ]
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
- @+ f# x/ |8 |6 p, x  kMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
9 W- Z+ b7 M3 U* }0 a" Z. X, _, B* ]McASPTxEnable(SOC_MCASP_0_CTRL_REGS);; q& f! b* H! c
}
# ^  g5 K  Z, `. N* j3 y& j
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

( h  Z& C8 \* V8 V2 e8 M
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