MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
* O0 K3 r, O8 cinput mcasp_ahclkx,8 y9 T  w9 f" N) T9 ], Z
input mcasp_aclkx,1 S9 l4 p( q8 E# u  t; d8 j4 N
input axr0,
) K& L( w: s$ A, \# _. w
1 M$ L/ |4 T; P# ~) Coutput mcasp_afsr,
+ G4 s' h6 S" |) s# H% foutput mcasp_ahclkr,
% I* |5 h5 t4 t' E; {3 d8 toutput mcasp_aclkr,- n2 U* ^. T) H2 m
output axr1,
7 C" c. t- c) _! v
assign mcasp_afsr = mcasp_afsx;
% s! X0 V/ a. i* s" v# bassign mcasp_aclkr = mcasp_aclkx;
% h2 W9 a& K2 j; j  N3 l9 w# Bassign mcasp_ahclkr = mcasp_ahclkx;- {$ z7 f$ X% }3 ^
assign axr1 = axr0;

3 _  Y4 k. V9 I/ Q: n( G3 F9 c
5 b' m2 e) o$ Q; }
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

" I6 C7 P$ G) w* R; C6 ]3 w( V3 @4 s
static void McASPI2SConfigure(void)6 u" G- h3 \, E' _
{9 ^; ]1 d/ U! @! b1 D
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
8 z; ~2 K; m0 |0 L) ?$ Y) CMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */& j- J" A) O. Q+ p3 Q- u- h+ z
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
, Z5 i; B1 j. z2 W! J; g& G- rMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */6 J7 ?* l7 J, i' n" \% k
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' |6 p" O/ e: q/ Q
MCASP_RX_MODE_DMA);
, o; ^9 B7 @1 ]6 p/ t# QMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,$ i8 h" _6 ?* U9 W
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
5 h% s: F2 N' Y" o. G8 DMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
+ }: Z6 r  S5 n2 m# V% NMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);0 t" N- |, Q9 W3 |
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 7 M5 c" f+ |9 ?* T3 N4 L5 U( k0 ~2 x, C
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
9 m, Z' q: p8 c' K5 D3 C2 vMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
/ ~9 o  X9 r1 k- [& {: ?: M$ GMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); $ @9 T) r9 }3 A" v/ D0 P1 \
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,( B- _/ h  D7 ?2 A5 t: d
0x00, 0xFF);
/* configure the clock for transmitter */
0 F: j" w/ ^6 s* EMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);! t9 T* F; W+ R5 ?5 x4 _
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
0 s$ [! [' w$ Z% U5 d* FMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
. v+ M# p; n, z8 e5 {6 {; x: f0x00, 0xFF);. d/ Q1 F+ s+ e+ ^' D

; x7 c0 `: _4 x% b/ U# Y/* Enable synchronization of RX and TX sections */ " R4 T8 z% K( y* K0 ^" m5 J- T
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
0 z/ M2 g$ Q: ^$ J2 aMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);: Z+ l/ }+ L" Y* R: R6 [
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*  Y* n! z# @* Z5 }
** Set the serializers, Currently only one serializer is set as& w' [( ^, t1 x! i: e; e
** transmitter and one serializer as receiver.. `( k+ O# J3 t) y+ w/ y
*/
0 u' p# q) R* m8 j" Z7 mMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);. E( n! S2 m$ _5 G, b0 a0 H) h
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
4 S* C/ d& ^5 j* m** Configure the McASP pins . `: i5 O! ~- ^% {( y/ y6 c& S3 I
** Input - Frame Sync, Clock and Serializer Rx; {2 K8 I7 \5 ]) b4 b
** Output - Serializer Tx is connected to the input of the codec
. |, T$ Z+ X# B*/
3 f; Q* z; E- O+ I, a5 tMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
1 G! t; P9 y" U5 [McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));9 M/ ?/ A# s( Z  W" q" [( E( N  V
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
3 T1 h8 e. w- u5 U/ V5 P| MCASP_PIN_ACLKX
3 p; D: r. y; q4 w| MCASP_PIN_AHCLKX1 a/ P5 a" s4 B( q2 ]" S0 x
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */7 x3 G) X4 T" G0 d1 g9 T9 M2 p
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
0 g6 ^3 q$ W( K9 {* L' i| MCASP_TX_CLKFAIL
/ ?- u2 H0 c; v% x# h% D| MCASP_TX_SYNCERROR
- M2 T( U) s: T$ I4 V" ~| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
$ e' |( r) p- h| MCASP_RX_CLKFAIL; J7 R$ j. E  M* G( O
| MCASP_RX_SYNCERROR 0 v; y) e- ?9 N2 x  r) i" n
| MCASP_RX_OVERRUN);/ X) h, ~2 w- j0 l
}
static void I2SDataTxRxActivate(void); ^, i5 o. y5 D$ ?
{0 M% C& b6 o) \" M! v- `, u# [7 X
/* Start the clocks */
* P8 o& X: S5 `8 c, C# [( I  R! Y/ JMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
: Q2 w. n3 ~: P( C4 U, sMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */9 y- H3 Q9 J- ^9 K3 _* A5 \& P5 g
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,9 `* |5 k8 U- R' H! R
EDMA3_TRIG_MODE_EVENT);0 H  Y: W, t$ f* O
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
0 D7 B$ M# U1 u7 }EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
4 h: y% J$ l$ m+ a7 C* ?/ b3 q5 f  cMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);3 a3 ?! @) v, F* n
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
* l5 `) r* A# X, L7 ?2 Kwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
: k( n2 r6 ~/ P1 W8 J$ rMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
9 Z- F2 R1 v% L1 s1 B, y7 g, A0 XMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);) a% c- S% F0 D% g6 r1 I
}

. V$ n( ^& H7 N. Z0 P; x: a
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
- G3 ]& h, y# }2 |- I) N6 O
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