MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
. S, g3 K' j5 s9 n# h8 T/ kinput mcasp_ahclkx,) p6 D) B; k7 Z. C
input mcasp_aclkx,. x" b- |8 n  n$ e" G& {/ |
input axr0,, r3 v. |% y; Y" r4 P1 ^3 x
) I% V! g# v& V
output mcasp_afsr,
" s7 E2 M7 ?) R+ z* coutput mcasp_ahclkr," z9 y( `* m7 ?) |
output mcasp_aclkr,+ l8 H, Q: P+ J1 ~1 m
output axr1,
( u% J* s# Z6 S; S' L
assign mcasp_afsr = mcasp_afsx;, ]( S3 j$ @) N) z; h. J$ G( s; O
assign mcasp_aclkr = mcasp_aclkx;
4 J; n, }0 Q6 _assign mcasp_ahclkr = mcasp_ahclkx;: b% _( E/ w8 X! I* e
assign axr1 = axr0;

6 M. g* d$ Z9 o) Y+ D7 L6 N
# S6 E9 t5 H! o0 \5 N$ j# b
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

% p& U( I) ^4 F% @+ a3 F" H
static void McASPI2SConfigure(void): c8 r# H5 }) ^7 V8 }  P* l1 k9 \
{+ C: B7 T$ N/ F6 c( ?1 F6 g8 ~
McASPRxReset(SOC_MCASP_0_CTRL_REGS);3 @/ D& Y% b0 D2 T5 _! @% C
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
/ c9 J# V' Z# T; S2 k2 sMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
! Y) n$ @* k9 m& ~McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */) u7 I, \1 ]" u5 u# U
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
9 `9 w* j. d0 \' `0 l0 i  mMCASP_RX_MODE_DMA);9 N- U8 i- M  I3 ]' k. `
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,7 W( U5 K4 U$ j, z1 S- O
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
  v( ?6 Z  i  tMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
1 \* W, N7 k( b; QMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);# f: i7 h9 C" F' b5 U
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
6 k3 D4 ^- L# ?MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
7 T( {$ T/ I7 K4 z: |; EMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);8 L: c9 ~3 ^8 i& u8 k2 Q2 e
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); ' s& w0 T5 I+ ~
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,5 O. a* A  c; z8 t" T+ T2 g! R
0x00, 0xFF);
/* configure the clock for transmitter */8 {# ^' P) W  a' V
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);" N( z6 l8 @: U
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
& A* `! o" }' y( e3 e8 \/ wMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,& {0 s& |1 D% O2 L) r
0x00, 0xFF);
8 e& v5 C; z. G+ _
4 f  n( K/ J' y# H9 u/* Enable synchronization of RX and TX sections */ 0 J( e. J0 z' `
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
5 u5 x( q3 M; Z0 r/ wMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);1 M- k/ z) M' g- X/ x6 |7 y
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*, d8 g% d2 u- z9 W/ ?; F# O
** Set the serializers, Currently only one serializer is set as. q) D* T% G7 Z
** transmitter and one serializer as receiver.; L2 v0 P$ g$ B% V( j
*/1 [$ i& W2 Y4 R, f7 C
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
: v# P4 t: c7 X) |* p* e8 tMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
/ D+ T# w( K  V/ Q** Configure the McASP pins
, A4 [8 {) ]( ~- c5 E** Input - Frame Sync, Clock and Serializer Rx
8 T7 L5 _5 I+ s5 w** Output - Serializer Tx is connected to the input of the codec
$ V6 o9 G9 d8 U( f, C6 u*/5 w+ y, }( }% U7 g; n1 T0 s7 |3 y
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
- w# R7 W: ]2 ^2 k7 hMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
3 o4 Z% A$ ?: M0 n3 o9 E' }* oMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
% W- a9 z) S& J2 k1 g% ?| MCASP_PIN_ACLKX% U! h- x- ]( l' p4 g
| MCASP_PIN_AHCLKX
: J7 q! h4 w. \- j/ m| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */& M8 i; ^4 S; z) U5 U
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR - H& h# N4 y, Y, d2 E, W
| MCASP_TX_CLKFAIL ( E- ?/ S3 R( C' L  u
| MCASP_TX_SYNCERROR' o, U  j; y' a- U! h  [
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
! `6 T, {+ h  S9 w4 p& {| MCASP_RX_CLKFAIL
% s: n7 c+ ^9 T: t, M6 F% J| MCASP_RX_SYNCERROR 4 w3 e' o/ F2 |8 m" W+ h" R
| MCASP_RX_OVERRUN);
& P+ u$ L' _$ z- ]6 n}
static void I2SDataTxRxActivate(void)
4 V7 N' b! m, A1 R) [% q{( g5 f/ d& L  L: r: Y' R7 G
/* Start the clocks */
9 h( \5 B) X; h& G" \/ K, YMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
2 B! L% O' {; q6 r% b- ~1 |) UMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
# K3 X' ^* ]8 t+ B' G$ aEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,6 @% F* j: C: b* P( s" F8 ?. h
EDMA3_TRIG_MODE_EVENT);/ ~; \6 W# Y* v. l- x- H+ }
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
! h6 b( l8 r0 Z6 y9 ~. F0 ]1 s6 ^2 aEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */9 [6 y5 j4 S1 B$ J
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);! N( Q- b3 s- o, I
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
6 I' z: M6 B4 V: ]) u. vwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */) n' M2 ?7 K$ L: ?$ z) S4 Z) U
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);! r4 E+ n4 }' p
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
0 w2 U) q0 _, ~5 N( ]}
& [2 U9 p, j8 z
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
8 S7 c3 [# ^' j0 c+ c
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