MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,% H$ j- P4 i3 P8 E7 v
input mcasp_ahclkx,/ e: Z& I1 @+ r  ~! Q
input mcasp_aclkx,
0 I5 A5 A$ ?- ]" R1 ?& \input axr0,7 n. g0 F% r4 y) X  l
, z# W3 U7 Y$ P$ K9 B
output mcasp_afsr,
% T6 l2 U9 g* V8 soutput mcasp_ahclkr,9 h: d: n: x- H- f7 K1 M1 D1 ^
output mcasp_aclkr,
! `9 g; G3 a% Q* k7 `output axr1,
) g3 v& V$ O" L: I( _4 n$ R, p
assign mcasp_afsr = mcasp_afsx;
# D. z) i! Y( G/ [, ^assign mcasp_aclkr = mcasp_aclkx;
* J2 [; e0 `" Y1 M7 O0 v! Nassign mcasp_ahclkr = mcasp_ahclkx;' c/ x0 m" Z( _' F% l# H, m. v
assign axr1 = axr0;
2 e2 A- Z& p1 M" n
; Z' l7 k5 I# s' U
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
' W4 d7 D  v1 X( S  k5 |
static void McASPI2SConfigure(void)5 B# ?/ E9 a: n# u) |
{$ h" E" E% C# T
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
2 z: t" g0 p" M: X  z& UMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */( r# J, r8 m1 \% V- B! }  i
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);- F- t9 O6 b" d2 N& s
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units *// G7 A7 Y# f' L; R9 i
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
2 i* S2 u) w& f6 H) {( fMCASP_RX_MODE_DMA);2 Y9 |- K2 p" F7 v  a' e; r% c
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
! a. Q5 k8 O, k9 M, t. F% O2 w% {MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */) ?' _( U: ^, `& Z/ `
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, * N( T6 E4 n! e' I
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
! I- r% r0 j9 \& i' `McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 3 P, \4 b& B0 F5 Q6 O
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
( _+ f5 z& {# f2 nMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
7 E# M3 G1 _% j0 u/ E9 x1 LMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); # |6 M" L) u+ R/ g
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,0 V0 x+ l8 R5 r5 ?. b3 @- |5 K
0x00, 0xFF);
/* configure the clock for transmitter */
# O. G3 Q% M6 Q; E# @( pMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);, R& l" o4 V. H, F- l
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 7 k, ]: }8 b' |7 N: X% S- L9 m( t
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,: Q$ ~' F. b" b" q
0x00, 0xFF);! s4 p  u0 `$ J7 Z  i7 p( w
. f' \. S7 s9 A: F. d; A
/* Enable synchronization of RX and TX sections */
, M% s* R4 O1 M4 S& hMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
- q. z2 j: n' [# UMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
3 G# m( Z+ w& t* ZMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
# x& T% O" B+ Q** Set the serializers, Currently only one serializer is set as# c4 a1 [% X( [: _: x0 q
** transmitter and one serializer as receiver.
- ^- c% l- F0 K1 O2 m*/7 }$ x! l9 y  G, c5 `4 t5 a- Y
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
: t2 o3 {: Y6 D2 f' N$ @McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
. k& {' f1 K; ], t+ t- z$ i6 H** Configure the McASP pins
$ D/ _2 \" t0 F. X# }7 J** Input - Frame Sync, Clock and Serializer Rx
8 V! K) J7 C% \+ H* l+ V% F. a' q** Output - Serializer Tx is connected to the input of the codec
7 Q$ K' I3 x4 l*/
" Z6 r9 w5 a+ m- c7 ^& [McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);8 Y& B0 A4 b9 o
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
2 y% F2 b3 z. {1 ?/ m( ]McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
9 q% w- r& z0 a| MCASP_PIN_ACLKX, ~* X: g& s( v$ l8 ~, H
| MCASP_PIN_AHCLKX6 H4 \+ H9 |% \/ @
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */- q; H* Y, r+ w
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR : V! V, t! d2 M+ y# d; ]
| MCASP_TX_CLKFAIL
0 E, w. L3 f, A4 T1 O% m9 _| MCASP_TX_SYNCERROR+ B/ l+ \6 J0 W5 H& t0 }0 C
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR , p) Y0 p+ Y9 a# _
| MCASP_RX_CLKFAIL
! ~) Q- l* k8 d| MCASP_RX_SYNCERROR % }% F& l: ]- V) ?1 x4 R
| MCASP_RX_OVERRUN);8 i4 @% o6 p  R5 b- j0 ^
}
static void I2SDataTxRxActivate(void)( J5 h* o  d& e* Z( z& W" \
{6 Z1 a  |, _* {" B
/* Start the clocks */
. E( J" e0 `, B/ bMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
% R9 [6 o; l# S% R0 D* B2 S* r, wMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */4 Q. X6 _/ p. ~9 o& R
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,% @" F% @. E$ q, p5 F& V! |7 L# y
EDMA3_TRIG_MODE_EVENT);0 V" H5 ?# h" X8 }  u8 F$ R
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
7 G6 P3 m3 j" l5 I- u( BEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
! C8 u" N6 f! ]4 s% x7 DMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);8 J1 y( A& \* r. c1 Y
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */' a8 ^6 a4 h7 g3 l% a
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */  H/ y- g. A) O/ _3 S
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
1 i! ^+ d' P$ X/ V- Y/ rMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
- k- X7 M8 D$ X+ u0 w' P9 E, u}
3 n9 z; D: s3 b! e- w: p$ \( z
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

% a1 p: B  g' R3 @
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