MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,9 p) b6 h1 L. G; E  s
input mcasp_ahclkx,0 M' y! {5 Z; V+ E' R7 e: ?
input mcasp_aclkx,
5 C1 m& z* i2 M$ t$ |input axr0,
& Z7 u. d% ~1 E: H. P
4 R$ _! u+ S, Q+ L) \. F  @* b- y% }output mcasp_afsr,
0 X: ^, Q7 W/ X, ~; a; C! voutput mcasp_ahclkr,
5 |; X* H7 w! u3 G/ T* Woutput mcasp_aclkr,7 O! P; {/ k8 `' {$ I
output axr1,, {$ [* g. [# g7 r. U
assign mcasp_afsr = mcasp_afsx;
+ H1 N0 D" }; U8 sassign mcasp_aclkr = mcasp_aclkx;
6 F1 t5 H" e; o. c& P* qassign mcasp_ahclkr = mcasp_ahclkx;
0 `8 `3 B" `; L* u& s& Y  tassign axr1 = axr0;
, V9 W! u, ]  o5 w! t

0 L: y9 L: t) C
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
3 B- @1 _, y- `* g3 q
static void McASPI2SConfigure(void)3 d( P6 ^& L! j0 O
{
3 K. p& v) Y& I5 z* j( AMcASPRxReset(SOC_MCASP_0_CTRL_REGS);" J  R8 Q% \% G' p
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
0 t& V& ^2 }3 ^! YMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
% A/ D* B; b7 e3 bMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */& R3 t- l8 y6 ^- i; p) m
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
! e% g- X5 |6 D8 g3 e: T: F. UMCASP_RX_MODE_DMA);
# r1 V2 _, P3 I5 f8 _. \, p) D! LMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,' b7 F3 Q* d; }, K( e# r" x
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */$ h1 Q+ B$ b$ o% b3 M7 }& u/ y
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
) H; Z# w  Q' kMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
) J3 P) ^: k) `1 d9 V  V! L9 l- \$ T  BMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
1 V; Z8 O% f% V9 Y6 A* Q  k5 \MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
8 e- u  A" b5 kMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);; A0 B  _8 Y% E* I. j
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
- y' t% W# R- tMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,0 k( q. i6 g+ x6 \, i% j
0x00, 0xFF);
/* configure the clock for transmitter */2 Y+ z" I( }8 V+ I
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);5 ?# A+ u- ~5 X7 t
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
& [$ k( a  _6 h+ iMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,
$ s$ r0 z( d7 E* C, n0x00, 0xFF);6 I1 o6 A* `, K: I0 k

1 M0 l( O% B# y' W7 }% Z9 C8 T2 v& t/* Enable synchronization of RX and TX sections */ 9 G) @6 z0 k% ~+ h
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
# T$ S- z! X: u" W  XMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);* S5 y) o- ?4 j( s; W4 X( r
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*  X5 ^8 @5 i0 [" j( ]
** Set the serializers, Currently only one serializer is set as
6 w/ b5 K( i7 g- z: _; o  V( W** transmitter and one serializer as receiver.
4 D( R0 |+ j5 {7 J& d1 b0 O9 c# Y$ E*/
4 r, f  o8 R7 [* e" p8 eMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);* k. B: ?  F) Y% r3 r
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*  H! d7 V9 Z3 C; s- n- R
** Configure the McASP pins & e( p$ C1 n% @0 s6 X0 |& ^  |8 U
** Input - Frame Sync, Clock and Serializer Rx
. c$ K& c9 Z5 s# b9 o** Output - Serializer Tx is connected to the input of the codec
( o+ _2 P$ e7 S) E*/) Z; M* a, x2 q9 D9 w
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
% c4 J2 S8 N" z" [+ bMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));0 t! j% w9 |$ b6 V: {7 c( b
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
! V; n% D0 r4 h, u! a| MCASP_PIN_ACLKX
* A3 m5 E$ x; q9 F| MCASP_PIN_AHCLKX
9 y! |& n& R. h' Q/ d| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
; R( I7 Y! B  Y1 a. [) L# _McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR ! |( {  c" T! {$ G* b; ~% W
| MCASP_TX_CLKFAIL
* e8 V) X" L3 \| MCASP_TX_SYNCERROR
# o( f+ S. i2 Y$ l2 R| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR - P# }6 c2 \- o& l( X
| MCASP_RX_CLKFAIL
) n; O. f6 I. m5 X2 ^) x; || MCASP_RX_SYNCERROR . v# v/ H; M. x! @: k) n# [
| MCASP_RX_OVERRUN);
: L9 G1 d' c+ [/ W" d/ C( V}
static void I2SDataTxRxActivate(void)
/ ?2 S# D+ S$ |) ]7 ~  M# ~) Y{+ }+ x3 |5 {) n: e% T
/* Start the clocks */
* y( z6 W6 }/ X0 W$ T6 Z2 EMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);+ n  |4 e* e7 T$ r8 q1 k1 x
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */* d/ H) A. |1 d9 }7 h
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
: F8 r+ l" d7 z0 b7 n* v5 AEDMA3_TRIG_MODE_EVENT);0 s8 _6 d" ~/ W* o) P/ Z; ?
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 4 Z+ [9 _* F5 K6 o6 o) u
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */2 ]0 F+ S+ r+ q, ]5 N6 z
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);, v! S2 y  p: U
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */- {( x  j1 [2 a3 D9 l- P! P0 X. L
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */! o; Z$ M& N2 v+ A% f; F6 V
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);6 ]* K9 O$ w( T/ V2 ]
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);; n$ t: S8 H6 e# d, Q% p
}

  t5 z  i7 w! _) f0 v; j
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

9 l8 X) U: W9 k) g& @% Y7 n
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