MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
! [. _: r8 O6 ~4 D6 N2 \1 Sinput mcasp_ahclkx,$ w+ `& r- ?/ \- w) r
input mcasp_aclkx,
' `; |& X$ [: Z! S  Z2 k$ n) ~- Pinput axr0,
) ~. c& \; ^; d! ?$ J5 K, n0 G  P. S6 P- {% k. c3 q6 V
output mcasp_afsr,3 y) r8 a6 D9 v5 Q
output mcasp_ahclkr,
( h) W( f2 X. e" }8 y- houtput mcasp_aclkr,
1 q# d) J6 |9 T* ~# X2 zoutput axr1,
4 M" ]& m; a8 Z+ r1 A, I9 w
assign mcasp_afsr = mcasp_afsx;: K/ p8 f8 T1 O/ a. @0 C
assign mcasp_aclkr = mcasp_aclkx;$ k, O) ^# D3 f6 y7 g
assign mcasp_ahclkr = mcasp_ahclkx;# q0 Y+ I) k7 A" A
assign axr1 = axr0;
. w. O! a% \4 N4 Z. j+ a
- p/ d# X5 g" j" u8 W3 m
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
  L+ z1 M! B9 F2 h) ^
static void McASPI2SConfigure(void)0 |  j6 M# w$ D5 @3 W- Y& }  @
{
, Z+ |- }8 }3 x$ G) F9 p4 gMcASPRxReset(SOC_MCASP_0_CTRL_REGS);3 |6 h5 p( t* g1 S4 T# ?: F0 F0 S
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */. K% L7 w# N& ~$ t, U1 W0 z
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);" I  I3 F; s; a7 x( @8 y2 g
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
( U! n5 P1 |. c# Y" R- sMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,% X8 H2 \2 @: Y1 |* c% W( e
MCASP_RX_MODE_DMA);
( L/ k: K0 x4 M2 T( g9 y. q* NMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
4 R1 N. o* O. q+ a1 ]MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
$ i, ^& C0 i/ y; ?3 b& bMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
3 h3 ~. `3 r& \  V% R9 H- U( N( N; xMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
+ M. G. j5 u' N8 MMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
9 x4 C) ?6 i3 \/ pMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */) z+ v5 Z2 M8 h# I
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
% l0 v* P4 U( O5 @; h# l7 b/ J$ F+ T. mMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
# g& j& t% _( lMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,5 f- x- |6 m1 b
0x00, 0xFF);
/* configure the clock for transmitter */$ T- A1 v' p3 ^1 D5 D. ?
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);+ z& l, L$ T" z0 I4 M1 O' I( O
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
. g! S( R' q1 ]" JMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,. N- _' E6 u" j  s) j. K
0x00, 0xFF);4 J* m, g7 ~: p7 D
: g/ ?# j9 n: r/ u$ B0 a
/* Enable synchronization of RX and TX sections */
/ K9 V0 ?1 E3 |) KMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
7 |) C, l; t, A8 ]( z# u2 ^% h! X$ KMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
% u0 y6 q! d2 M) X! j6 `& W) H8 OMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
  A& h. n" W6 z. L) N; Q0 N& S** Set the serializers, Currently only one serializer is set as3 X# _' ~& C. _( t3 k
** transmitter and one serializer as receiver.
/ }8 b  I, s% F7 R( Z4 a+ Z8 Y" b*/1 u/ K* f1 X, X! b  @- X/ r
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
/ ~% f" E8 m7 E8 K& eMcASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
5 K$ a: z3 R2 {- L* U' Q% M8 e7 K7 w** Configure the McASP pins
7 C: F% I: B/ A$ }: q; R** Input - Frame Sync, Clock and Serializer Rx
8 {) }/ D4 J4 o6 R1 @** Output - Serializer Tx is connected to the input of the codec 8 ~4 t( _* o; R& q: a. O/ z
*/
: T' F! g" T( L  z, _McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
: m; b% j9 a( b+ d8 e; }8 V* f9 `* xMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
, ?, |) q& S; U* l: o. qMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
, D. b3 R& ?* t- K9 c: C| MCASP_PIN_ACLKX
$ S1 d4 r. w6 m' I  }7 @; t| MCASP_PIN_AHCLKX+ i0 {) U; U) K% J5 R4 X
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
! A7 H; K& [. _# C7 m" _+ YMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
* ]1 k- E2 E0 \# \- H| MCASP_TX_CLKFAIL
: _6 A! R. ~: T| MCASP_TX_SYNCERROR
, S& m( |' c9 ~, l( Z| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
3 E$ ?7 y2 h& n2 s2 A$ o* f| MCASP_RX_CLKFAIL: s, C2 f" H: R" K0 w1 W
| MCASP_RX_SYNCERROR
7 b- m4 O' H! y' q| MCASP_RX_OVERRUN);
6 T0 r! v- e% h+ x. h  ^. o! o}
static void I2SDataTxRxActivate(void). n& p! p8 m# t0 K6 h, S0 h
{: n1 S1 X1 R, r( p: U. h4 z
/* Start the clocks */" V+ A3 H5 ~0 h; I5 X$ g
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);& M: R  H  E7 w, @7 ^! h
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */: h" Q0 p6 j: r$ ], I
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,
2 f, M* H0 w7 C- c( p) DEDMA3_TRIG_MODE_EVENT);4 ?* _  J8 ?, i% `1 P+ Y
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
3 \5 p& B* K1 N7 J+ e* yEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */* i: J3 K; C/ n: G$ L
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);( ?. v( Z& m5 C; z3 Z, Q
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */# t6 r. w* N6 P2 E7 i$ [7 k' r
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
8 w* Z* l: U3 {" ?# [( sMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
/ k% i: F! d# g& Y( KMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
* K  d1 k7 e. A  X* X& H# C3 Y}

7 ]5 M( |; [) J0 U
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
' w$ r( o; e* i' |' @; A( A
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