MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
7 @8 t% F( U/ Z2 m8 Hinput mcasp_ahclkx,1 K8 r: I1 J4 k6 B/ c, Z
input mcasp_aclkx,% k9 o5 \+ \8 V. |  H+ O! ]
input axr0,
9 B. V3 b& d, K$ N- F
- B0 w& V& w% xoutput mcasp_afsr,
3 N' k) m. L0 W+ Q4 Goutput mcasp_ahclkr,  Z! N# S; s1 H' y7 s* Y3 @0 @9 }
output mcasp_aclkr,
3 N2 l: ~3 G9 ^) D' i9 [5 I* Coutput axr1,
4 [! w9 h" K' Q
assign mcasp_afsr = mcasp_afsx;
6 j+ X7 c7 s: J. r8 Hassign mcasp_aclkr = mcasp_aclkx;
. D8 Y! P9 U$ H4 O! j2 R% rassign mcasp_ahclkr = mcasp_ahclkx;4 @( Z, M" Z6 |0 Q+ f9 j
assign axr1 = axr0;

7 n+ m; x8 n# ^! x& g- }/ V: Q5 X* U1 R
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

" A- J, m% `- D- k
static void McASPI2SConfigure(void)9 b9 `# o  h: _. {5 `' R
{
+ |+ c$ ~* _. V8 Q3 k6 q' r5 t& _4 zMcASPRxReset(SOC_MCASP_0_CTRL_REGS);2 [4 d2 S% w" H! s0 g
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
+ R# `5 T* ^8 H/ V3 J( B2 x* GMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);1 t3 Q+ Q! C6 P9 b
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
- m) M- |; b/ o) H9 \( iMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  a, d, i- g3 G- ?
MCASP_RX_MODE_DMA);- ]  f. c" y9 J# q2 r
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,  l# S4 s! l6 T
MCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */% O. h, D1 [, {5 x: D3 t/ S
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
( Y6 v& _4 d( e- iMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
9 i* d( u/ \1 m+ d7 fMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, 7 v4 W& \6 }$ n! z; `: v/ R
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
; D2 D0 a. S/ d3 z. y% m3 KMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
  B* W2 ^% B% G# c; w7 CMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
$ w. P7 C0 W6 ^, EMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,/ D+ ?; \  j: o" z
0x00, 0xFF);
/* configure the clock for transmitter */! l: m* m7 s& i) J+ k* G8 q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
$ Y' Z3 O2 I" a7 t: i8 k2 XMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE);
4 J8 u  |! m; D( J, mMcASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,) y2 N6 b$ `4 ]
0x00, 0xFF);. W$ W$ Q! U6 E* a
* s5 z- N' E3 b/ e2 Q& r4 X4 G
/* Enable synchronization of RX and TX sections */
3 `0 }' D/ f% [6 |: j: O% sMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */, [- g$ h2 s, W2 n  ]- l
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);0 l" F  {; F) v! M- R& o  @8 M" @
McASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*  C  E4 B# Y3 i1 ^: t9 E4 r
** Set the serializers, Currently only one serializer is set as, I( m! V) N( i
** transmitter and one serializer as receiver.; P/ |3 [  H: S% E7 `; |
*/
. n9 q. i! A  p- TMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
( M& j, n8 W0 [) g2 K6 Q# [McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*7 y3 v" H7 q4 r; \
** Configure the McASP pins 8 m0 s7 e9 v8 x! h! ^: ]9 f
** Input - Frame Sync, Clock and Serializer Rx
. C9 U/ B- h% Y3 B2 E** Output - Serializer Tx is connected to the input of the codec * d$ g4 v* r/ `( q1 [& e
*/+ W3 e! s* F8 v: N; S2 Z
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
2 ]( |: \2 T, R3 |0 x  DMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
$ q; Q& Q& a' A4 dMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX( E0 d. l  K8 f6 i& O- F
| MCASP_PIN_ACLKX
4 v7 w1 V6 }  y% T( A| MCASP_PIN_AHCLKX
9 N9 U) u7 C" L% x/ d| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */5 C/ w, O* X" U6 L! a
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR / l- p6 t) c5 G- ~3 O3 W
| MCASP_TX_CLKFAIL
. O/ y/ @$ A0 ]/ V% e| MCASP_TX_SYNCERROR
5 S1 Q3 [5 O+ `| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR % N1 g8 M/ p( `- z, w- R
| MCASP_RX_CLKFAIL: Q( k7 ~$ Y6 h
| MCASP_RX_SYNCERROR
* j- P# f4 F, Z8 k; R| MCASP_RX_OVERRUN);+ o* f4 ]: d0 k" B) p
}
static void I2SDataTxRxActivate(void)6 t% {2 I/ O. M8 L, I9 b3 R: z
{
2 Q/ \, c4 s5 D, x/* Start the clocks */
$ E1 D9 t* R  x% A+ e9 S" iMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);3 |5 ?+ w2 K6 ^9 E% N; t) s6 t2 a- K
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
- e5 Q$ s" F8 t+ S& S# oEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,5 H$ t3 r, f* _- j( a% T
EDMA3_TRIG_MODE_EVENT);) u1 e" ?/ n2 L6 ^
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, ( ]/ t4 ~# g' u$ M& r
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
- Z$ i$ [( b* p3 ]# hMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
$ p! K; }9 k1 ~2 l6 ]0 GMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */( E! A" a+ ?% ~4 ]8 f9 p
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
! H  n) f8 C- S: a8 [McASPRxEnable(SOC_MCASP_0_CTRL_REGS);% v5 p3 s" _* ~6 X  C# O4 q
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);" U. w' S- U  b; r
}
- e/ n9 }6 G( O
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
+ }) }1 N! m" ?7 x/ }1 `# P
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