MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
4 m% N+ e* v1 w- _( F/ U( b0 {input mcasp_ahclkx,
$ L6 i# r; P' ]input mcasp_aclkx,8 k( o" [+ `; Z: u
input axr0,# x  q$ _) p: x7 H) d, Q

! t. x' ^, Q2 c, @/ \% aoutput mcasp_afsr,
' u4 }) A2 c$ eoutput mcasp_ahclkr,. |, v0 w( P& |( h3 r
output mcasp_aclkr,  P# |$ n6 x" d* C- u, x6 w; ?
output axr1,
* r, ~1 b9 _* l, e
assign mcasp_afsr = mcasp_afsx;( g5 O2 e0 ]7 D: K, s% w
assign mcasp_aclkr = mcasp_aclkx;0 }" |$ t- A+ @" p, r: A
assign mcasp_ahclkr = mcasp_ahclkx;) ]: |1 g) [- P% W
assign axr1 = axr0;
9 \6 a  Z4 V) W! _$ a

9 r+ G( t. Q! e2 R
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
5 g, u) ^  H# r" R: m( `
static void McASPI2SConfigure(void)
6 \5 q* [% F  U{) x2 W1 z( V: C; K8 ?1 V+ `7 _
McASPRxReset(SOC_MCASP_0_CTRL_REGS);
. ^+ w- a9 X; b' jMcASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
) r/ G7 o  v( ?8 V; k9 IMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
& A1 J2 S7 x. C$ e$ {) b$ \McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
  B* h; o) @5 `& DMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,* ~6 J/ ~' {6 l! F! b: W2 e
MCASP_RX_MODE_DMA);
- v" `4 ~0 W& Q+ AMcASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
  S% P4 y: F* G2 [# gMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */8 ]$ s: ~7 r( j3 T  P
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 3 E/ Y0 X. Z/ t4 F* R$ o* [
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
1 r' T* k" z, `1 p0 E" gMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD,
/ U( x  t! k+ w+ b( {! TMCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
" l/ X6 {1 d. P  i4 IMcASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);2 l& v1 ]  d5 G1 I5 p1 D
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE); 5 u5 Y7 |/ [6 J% H& ^2 A
McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
5 f9 \+ s* s7 Q0x00, 0xFF);
/* configure the clock for transmitter */
& H0 D  h7 Z" l3 X$ B" _McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
! b6 T" G9 s1 {McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); 3 B0 E6 Y# N0 i8 J1 O4 R
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,7 f+ ^1 b6 g3 r7 l. v+ m
0x00, 0xFF);5 u1 {( E% \9 [" O
" O/ F: M4 _: A9 [% N3 b
/* Enable synchronization of RX and TX sections */ + D( o" N( ^9 H7 ?
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
; w8 Y# i* C' G9 l$ @" ~7 _' mMcASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
( o3 M$ u+ H3 W& i0 O- G! wMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
0 ~! v% c% T% [6 C- D** Set the serializers, Currently only one serializer is set as
# x1 I3 V/ Y# z8 l. F** transmitter and one serializer as receiver.% z, r, H5 C! r: u( V* G! d
*/: i* L' X, x: i
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
! O6 a, [/ _8 j; Q2 ?' v3 V' ^McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
5 V! E  u7 X. t+ e* |** Configure the McASP pins : l5 h# s! ^1 N
** Input - Frame Sync, Clock and Serializer Rx( _/ t1 N* C1 }( b4 i8 c. ~
** Output - Serializer Tx is connected to the input of the codec $ {0 y9 G; [5 q2 s' W
*/
- ~& w- X/ k% k  ^: G9 pMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
$ D6 R5 [! f& ^McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
, j3 [9 c) B( t, Z6 wMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX# M& y+ [+ B, q9 {- K
| MCASP_PIN_ACLKX
" V% l$ C* O$ v! }: }| MCASP_PIN_AHCLKX
( t' r  r0 ]6 R$ B| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
. n0 v- t8 v8 {, G- }McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 6 e$ e' `4 ?% _, A
| MCASP_TX_CLKFAIL ! [4 ~# |* @: _) ~+ q  u% ~4 x5 K$ x* F
| MCASP_TX_SYNCERROR- x2 Z6 e2 q  N: h; A! d
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR   x8 t/ _. _4 {' r" n
| MCASP_RX_CLKFAIL
7 _* @' ]$ n5 ^# d| MCASP_RX_SYNCERROR
% b; w9 h: x0 y| MCASP_RX_OVERRUN);) [  R# u2 F3 W! B! R
}
static void I2SDataTxRxActivate(void)
5 }" E# l5 R8 M% M. t2 g" F{
( s/ P$ D+ I& ^5 W6 _. v/* Start the clocks */5 P" o2 }8 `4 T
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);
5 \6 c7 B1 g: v2 V( iMcASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
3 }+ u8 F- _, d& kEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,! K2 {7 J6 |' ]2 X: c9 {8 {
EDMA3_TRIG_MODE_EVENT);
: h( z5 C0 g* l! l! Y, }1 D9 }9 a2 }+ HEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
+ @7 ]2 H' a# V0 ~$ G8 W8 G4 JEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */7 D. [6 O9 N7 w  o6 [
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
/ z% ^9 q9 O' a4 C+ `/ u" ?McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */+ K0 |% ]" _  }* Q# N+ Z7 |% v
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */, x1 O& t/ a% _  Q
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);
- G0 w! l  c) w( _' V; k9 t# j3 t- T0 OMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
! z! b. A8 s9 H) [* g1 O' Z& n}
0 M7 t" Y: M8 H3 y
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

: o1 v: x  k! b9 i/ M( N  `
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