MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
; n2 j7 J: l2 i7 ^input mcasp_ahclkx,, X9 z& b5 K! Y: p( _9 z
input mcasp_aclkx,' T+ A0 E2 N* F) }
input axr0,
) G: S5 B- E: m7 ]) h7 G
$ f* H* i2 a4 \' p, F% a. C, {output mcasp_afsr,% s+ R; W7 J& k
output mcasp_ahclkr,6 M2 t" a& G/ T2 |/ a
output mcasp_aclkr,
  m* _' o- U- u" f: n: Uoutput axr1,
' C; S3 G( a' n( S, @/ t
assign mcasp_afsr = mcasp_afsx;
  m2 ]0 M, M2 e3 Iassign mcasp_aclkr = mcasp_aclkx;
) i; [# U, J4 [3 S2 Oassign mcasp_ahclkr = mcasp_ahclkx;
9 {1 v+ D" P) r  bassign axr1 = axr0;
% K( V+ o& P( o: e: f
1 n' I" J7 z& S3 R. g& p
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

  \& M" `2 U, F; D1 {& @
static void McASPI2SConfigure(void)
; K) c+ X3 b' X# O{
2 J1 x( _5 ]( l2 ZMcASPRxReset(SOC_MCASP_0_CTRL_REGS);0 Q6 F$ [! w3 |. c: S# P4 @
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */! ]# \; g. [8 P  M) H% c
McASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);4 Y  f' V) ?5 N
McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
  M+ O# n0 {4 G, ~3 G% aMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
5 T5 V8 H* q" U8 N+ V' G& eMCASP_RX_MODE_DMA);" x% U" X; X, G4 T& U' ?
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
% @0 b/ \8 t+ c6 S% BMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
- C& e% r: N2 J" lMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, ) q+ t) d* P4 Q/ x8 W1 w8 ]8 C
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);5 F' [' v. j& h, G1 Y
McASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, # A3 x5 S' @0 @: g3 {: l
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */
( m5 H) M- V0 }. l4 \/ @1 _McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);9 H' @% v& G0 B1 \- E$ b
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
0 b! A% |: d! Z3 z2 q3 [McASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,) q# \" U/ e$ |) b: P( B8 q
0x00, 0xFF);
/* configure the clock for transmitter */
7 Y( V9 _# |; fMcASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
8 F8 Q  g6 h) d0 TMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ' Q& `  j: ~+ ?, {
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32," q- z! {# p$ k) V& b6 {9 n
0x00, 0xFF);  w8 N- Y8 {, ?" P
9 g. V4 W* x/ W. q0 A+ c, Q7 l
/* Enable synchronization of RX and TX sections */ ) x) Z6 [: s7 [4 W9 _+ f" I
McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */! s5 u8 P8 l! `
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
+ d7 `* U% z1 BMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
; j+ Z0 v/ c( M2 p: Y6 n** Set the serializers, Currently only one serializer is set as
8 A1 R, e' D6 h8 o  V' B' b** transmitter and one serializer as receiver.
$ \4 i4 }+ v+ Z- D5 @$ _*/6 [3 j" o" g; ~  G
McASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);8 T: K! X1 Z" [% W3 o2 a
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
8 \: o  O& O6 e. s. k+ B8 J- O** Configure the McASP pins * ~' M  R  o9 Y6 S2 E6 m) w
** Input - Frame Sync, Clock and Serializer Rx
+ E, ^* ~" |, Y: s3 D' _** Output - Serializer Tx is connected to the input of the codec 3 M* a3 ?6 d2 H
*/
2 U$ K* \: v8 BMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);5 z/ c0 q) s- O( l+ H
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
; O% ~, i7 o/ uMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
- v: b' k9 L1 d% u| MCASP_PIN_ACLKX
1 b2 Z( _0 k% ?+ J1 w9 b  B4 T| MCASP_PIN_AHCLKX  x; M9 E  Q5 |- F$ o
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */8 P, p- @. A  f: H* K  H
McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR 9 {# H2 J" J8 c. @: C" q% g  k
| MCASP_TX_CLKFAIL 7 Z3 K+ s& d& O6 q4 A
| MCASP_TX_SYNCERROR5 H& U6 a' y6 l9 Y
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR
3 K$ }; c+ V* X8 k/ [; t3 M! h/ ?% K| MCASP_RX_CLKFAIL
; v" T' D0 Q; W5 J| MCASP_RX_SYNCERROR
5 A; r7 b  v6 C| MCASP_RX_OVERRUN);
/ _! a7 A$ S+ R9 B& [5 ]7 H}
static void I2SDataTxRxActivate(void)' l9 ?; J8 c2 s' w$ R0 S
{( Y/ v: i/ a/ O0 \5 S% t2 M
/* Start the clocks */7 t8 k. |$ i* E
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);' R) Z. j% j; K* w% m& z
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */
7 U, {. U' D+ W2 q0 {! b4 I8 dEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,* h: E% C7 W6 o7 e9 P
EDMA3_TRIG_MODE_EVENT);- c+ u+ o+ B3 c% ~& N5 J
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
. o' `# O/ n- k( X$ wEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
7 c5 Z6 K& i2 K9 Z- F! T- K2 `McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);8 |( @4 N% J; p$ X. t: Q
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */: e# l, ~# E& }+ Z9 }0 U' s; L, `
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */! m/ X, ~* H7 u9 [$ p2 ]
McASPRxEnable(SOC_MCASP_0_CTRL_REGS);9 M% H! l* F% y+ _0 S
McASPTxEnable(SOC_MCASP_0_CTRL_REGS);
( g0 ]" W- k" j, ?! |2 U}

7 X' X" X& d7 j7 |( n' k6 E
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
; G' W6 b& U7 i$ X# ~0 n
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