MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,2 i" _6 Q5 I) J4 R$ C( e- ?
input mcasp_ahclkx,0 t2 o; Q# R1 u9 ^( W( ]" G
input mcasp_aclkx,
" A1 r% R5 r/ N' finput axr0,# m) t& _, w' n( B% k, k) g+ A1 v

4 d. u  }# |7 xoutput mcasp_afsr,8 I$ q6 d5 |/ M2 ]: g1 ]
output mcasp_ahclkr,
$ z- F2 a8 B2 f+ i, W% `& T  ~output mcasp_aclkr,
, R9 Y8 w' e/ Y3 F( k6 Y$ Goutput axr1,
+ \: G5 K9 R8 `% F! h8 E
assign mcasp_afsr = mcasp_afsx;
$ r9 v' E2 b7 b- w- D  Gassign mcasp_aclkr = mcasp_aclkx;1 U% A$ V. x: Y  Z
assign mcasp_ahclkr = mcasp_ahclkx;
' q: [: N. f+ V4 m2 f* Jassign axr1 = axr0;

  d2 z6 R! n; _4 F/ @, @) B
8 G. c( s  x  o- Y2 S
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。

& a9 {: A5 O) B1 O% I' Y; x
static void McASPI2SConfigure(void)/ Z! {0 J% I0 Z5 b6 M
{
2 W) r$ N( A1 N0 {5 W+ jMcASPRxReset(SOC_MCASP_0_CTRL_REGS);# l6 s) `% U' O- q8 O3 u
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
& C/ P  s- j# B7 A% j; YMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
3 K5 ~( S& l# J5 K2 SMcASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */
/ J! E9 q" d; r+ i- JMcASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE," i! l* q# c( B( W) A
MCASP_RX_MODE_DMA);( h/ ^1 y- p. C' t
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
8 Q8 g& F8 p( _  F& H# L) BMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */, ?- {' Z( f8 V0 J7 y" s5 j* w$ O
McASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD, 6 N  y; R+ l+ k( n  b
MCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
, t) k" @# g4 nMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, % d8 H3 C5 S$ M1 d) ~, U
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */1 f  z* i1 [, o: p2 D
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);
0 o* M& T8 Q1 j" u( \( s1 T/ t" CMcASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
) e" `' P4 i  M3 J, r% J" pMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,
5 }, U  C6 m7 q" q7 [) L0x00, 0xFF);
/* configure the clock for transmitter */" N2 \: i. Q( y
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);' z2 W- L0 K7 \5 a. n5 e
McASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); * `( ~+ u0 d( ]' k
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,! t- U% H/ u! \5 t6 |# O; N+ V
0x00, 0xFF);% `) g; o4 G: g
9 m$ p5 m$ D7 R( \
/* Enable synchronization of RX and TX sections */
5 T0 ~3 x( D* \6 \4 Z6 ~McASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */
+ T# ?2 y0 t# K0 t+ g$ _McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
! E3 V4 g4 d6 A# q& yMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
* [& ], i/ q( P3 i% t** Set the serializers, Currently only one serializer is set as
8 v3 s$ h# B; M2 G$ Y, Y& M" A** transmitter and one serializer as receiver.
' }1 l2 p* d% M$ D  }*/
( @( V# s4 H; J* J( nMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);
3 F0 y0 N, h6 |McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*
$ Y" E+ ]* v% k" u  ]* d** Configure the McASP pins ( K" J% T. t9 l' W8 `! `
** Input - Frame Sync, Clock and Serializer Rx
0 j" u8 k; {& A3 l** Output - Serializer Tx is connected to the input of the codec * q$ n) C2 V& ^% ]5 e" a+ t0 H: O
*/* S4 U; F8 M/ t" L5 T! B# A1 G( c
McASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);
* b3 A5 u. m; h! NMcASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));
0 v- W/ b# w( Q( q# y( T# cMcASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX/ W6 q+ f; g( k, p8 ~* N; w8 |
| MCASP_PIN_ACLKX5 O% q  a3 K- u: A
| MCASP_PIN_AHCLKX
1 W  Y7 {/ k0 O) l| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
4 _# g! N% F# K0 I: VMcASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
* P& V: S+ \$ E& v/ S| MCASP_TX_CLKFAIL . c6 l! k. j4 C7 G$ T. H4 w
| MCASP_TX_SYNCERROR/ i7 k# r+ M' J1 f/ C
| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR / i& d; ?: G6 K
| MCASP_RX_CLKFAIL* N2 G* R# _2 S( V8 x. N+ ^
| MCASP_RX_SYNCERROR
! i0 u7 h2 T* {, a| MCASP_RX_OVERRUN);* w  P9 O. C2 ]; X" {. U
}
static void I2SDataTxRxActivate(void)- }6 F2 h$ ~9 Q3 c: w, y  h
{. S1 E# z% I9 r
/* Start the clocks */
* h: X/ L4 b: ]% J0 d( l4 JMcASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);$ L; f. S# ~# [  k3 i
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */8 S! g1 k3 M3 R: V0 K
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,! Z; p# j' u$ g& w5 F9 J
EDMA3_TRIG_MODE_EVENT);
$ E, C; w1 V. e% yEDMA3EnableTransfer(SOC_EDMA30CC_0_REGS,
8 z) l0 }9 d; D# @; t  jEDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */
% a9 @% P7 F3 X  DMcASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);
, s) m9 W% Q% NMcASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */; h% c# s6 ?/ e9 R0 a5 m
while(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
+ O$ e) c" l* q! }- W* o, mMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
+ L; m, U5 [. U  I- v0 wMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);
9 {- J, I7 \$ U  N) H' C}
1 e5 m" G) y9 l, b
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.

) M' L9 c1 T# P: q
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