MCASP自环配置。 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[未解决] MCASP自环配置。

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发表于 2018-11-7 13:28:07 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
我项目上用OMAPL138的板子MCASP的引脚都是链接的FPGA,所以在FPGA这端设置的MCASP自环。把axr0接收到的通过axr1发回去。
部分代码如下
input mcasp_afsx,
( ^4 e$ @& d% Z% |input mcasp_ahclkx,
% r9 P' Z* K! h0 ?! i. \input mcasp_aclkx,- t; {* B! c  j8 H  [
input axr0,6 z+ v% B  Q1 O' p% U' [# Z4 Z

7 j% C- x- i- C2 N( l* Zoutput mcasp_afsr,
% {- f" G. Z5 ~. o* P' A3 aoutput mcasp_ahclkr,5 t/ _& G/ x7 S" ?: t( d0 u4 A. q( |
output mcasp_aclkr,
, _: l! |0 O6 toutput axr1,+ x3 o" J: o( H3 l6 m! ^
assign mcasp_afsr = mcasp_afsx;3 V0 Q8 j) n0 U
assign mcasp_aclkr = mcasp_aclkx;
: u1 ^4 B, q! r+ E5 Cassign mcasp_ahclkr = mcasp_ahclkx;
& d. n- C% e  q) kassign axr1 = axr0;
# w/ ]! `7 N6 `
" ~! q6 ?  T% w* }1 N
在OMAPL138这端,通过axr0接口发固定的数,axr1接收。
在配置MACASP的时候,发送全部取内部时钟,接收全部取外部时钟。
一直循环发送,但是接收不到。在FPGA端也没有看到时钟和信号的波形。
部分代码如下,关于edma3的部分未做变化。
5 M! Z/ V2 v' b; I
static void McASPI2SConfigure(void)
, }' l- i9 Q8 J, l{/ h2 Z4 e& b0 ~8 [/ @- v4 [
McASPRxReset(SOC_MCASP_0_CTRL_REGS);9 f0 |+ \; V2 @0 J$ `
McASPTxReset(SOC_MCASP_0_CTRL_REGS);
/* Enable the FIFOs for DMA transfer */
& w/ ~/ w4 }; q; E* b1 H" o* eMcASPReadFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
7 T' N8 ~4 }& \- [McASPWriteFifoEnable(SOC_MCASP_0_FIFO_REGS, 1, 1);
/* Set I2S format in the transmitter/receiver format units */  N* g" [8 j1 d9 z' [, p
McASPRxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
4 K# ]; O7 I3 ^* H  g% r6 EMCASP_RX_MODE_DMA);3 ]! g: X; ^3 H5 S. p, H, S  \
McASPTxFmtI2SSet(SOC_MCASP_0_CTRL_REGS, WORD_SIZE, SLOT_SIZE,
3 x) S# g9 Z: c$ `! `# eMCASP_TX_MODE_DMA);
/* Configure the frame sync. I2S shall work in TDM format with 2 slots */
. A. b+ e3 n; v2 l" A" N# aMcASPRxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_RX_FS_WIDTH_WORD,
& F9 ]; C, E% h6 d* FMCASP_RX_FS_EXT_BEGIN_ON_FALL_EDGE);
' N% E. Y" a9 o  n- c0 kMcASPTxFrameSyncCfg(SOC_MCASP_0_CTRL_REGS, 2, MCASP_TX_FS_WIDTH_WORD, " G) ~: Z+ B3 z* {& y( M
MCASP_TX_FS_INT_BEGIN_ON_RIS_EDGE);
/* configure the clock for receiver */: W  K" E) W1 w; F: J0 [% Q
McASPRxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL, 0, 0);) S" ^# j/ |1 o: |' s
McASPRxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_POL_RIS_EDGE);
! `) H; H6 k/ P+ y9 UMcASPRxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLKCHCK_DIV32,6 n" [! u# ?' z' ?3 ?& Y- ?
0x00, 0xFF);
/* configure the clock for transmitter */% H7 M/ l% N2 K" q
McASPTxClkCfg(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL, 11, 1);
( }6 x0 H/ P4 x! H( \' ^2 X( MMcASPTxClkPolaritySet(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_POL_FALL_EDGE); ) C: O6 N$ \& l9 T' m# Z
McASPTxClkCheckConfig(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLKCHCK_DIV32,/ v) o* j& ?1 Q1 M7 @2 W( H4 o3 g
0x00, 0xFF);0 v+ ~4 n# `% X3 u+ m
/ W, P% u+ J4 a  p
/* Enable synchronization of RX and TX sections */
2 i1 G+ I  q9 N+ [5 c! JMcASPTxRxClkSyncEnable(SOC_MCASP_0_CTRL_REGS);
/* Enable the transmitter/receiver slots. I2S uses 2 slots */- h  t# s- @+ w4 N, D0 [  Q
McASPRxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
0 u3 S+ V4 P1 n! v& X! ]9 KMcASPTxTimeSlotSet(SOC_MCASP_0_CTRL_REGS, I2S_SLOTS);
/*
% X5 Z6 R$ H% n( T** Set the serializers, Currently only one serializer is set as
  {! F9 O4 ]( m; ]** transmitter and one serializer as receiver.
) r1 B7 I- d3 r$ D) Z*/
9 M0 ]8 D  s; wMcASPSerializerRxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_RX);! q" ?# z/ s) W* C, ?! Z
McASPSerializerTxSet(SOC_MCASP_0_CTRL_REGS, MCASP_XSER_TX);
/*0 u) u) `) o3 D5 g$ y
** Configure the McASP pins
$ V* j( d3 k/ r; W$ U& ?** Input - Frame Sync, Clock and Serializer Rx& T: i, ~3 H% K: @$ d7 c
** Output - Serializer Tx is connected to the input of the codec : J: [! k* Q! y; A! o
*/
. R" S( o" |+ |' `5 QMcASPPinMcASPSet(SOC_MCASP_0_CTRL_REGS, 0xFFFFFFFF);  w& p( _. \8 s6 Y' W) P: ^
McASPPinDirOutputSet(SOC_MCASP_0_CTRL_REGS,MCASP_PIN_AXR(MCASP_XSER_TX));7 B& _; d6 [9 U. a
McASPPinDirInputSet(SOC_MCASP_0_CTRL_REGS, MCASP_PIN_AFSX
9 p! ]( S- e$ @8 \| MCASP_PIN_ACLKX
: n6 }) k( u+ G5 N5 _* I8 ~4 v" y. Z/ o| MCASP_PIN_AHCLKX0 y' o4 [' X. R8 h8 ]
| MCASP_PIN_AXR(MCASP_XSER_RX));
/* Enable error interrupts for McASP */
7 R% I2 w/ c/ [7 D3 @McASPTxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_TX_DMAERROR
+ V3 N' t8 Z& ]| MCASP_TX_CLKFAIL
" Z$ V- m8 K4 T( R0 V| MCASP_TX_SYNCERROR
7 s! }  k9 {7 D5 K7 x| MCASP_TX_UNDERRUN);
McASPRxIntEnable(SOC_MCASP_0_CTRL_REGS, MCASP_RX_DMAERROR & ]8 f9 N: f; ~3 P& b" a
| MCASP_RX_CLKFAIL- K% r$ ^5 K. _6 j
| MCASP_RX_SYNCERROR 8 d6 e  D2 O4 W. O
| MCASP_RX_OVERRUN);
1 ]: N- j" D, Y! |- w; h1 m}
static void I2SDataTxRxActivate(void)
  z# E7 A9 x' W" S{2 K: F3 Y8 O! S# K# h8 N
/* Start the clocks */" F2 E8 N& V* n/ @2 u
McASPRxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_RX_CLK_EXTERNAL);* ]4 z, f+ r/ R- K5 I
McASPTxClkStart(SOC_MCASP_0_CTRL_REGS, MCASP_TX_CLK_INTERNAL);
/* Enable EDMA for the transfer */' |# d9 s9 P1 b
EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, EDMA3_CHA_MCASP0_RX,; }( I- v+ d% |% n: L  e
EDMA3_TRIG_MODE_EVENT);
( }1 u: c. ?5 E  L' J  {EDMA3EnableTransfer(SOC_EDMA30CC_0_REGS, 0 h4 \4 g7 M3 I- a  m
EDMA3_CHA_MCASP0_TX, EDMA3_TRIG_MODE_EVENT);
/* Activate the serializers */* T! t6 T2 F' ]" Z7 I# }/ \
McASPRxSerActivate(SOC_MCASP_0_CTRL_REGS);1 s$ J1 S2 Q* Z9 t4 {
McASPTxSerActivate(SOC_MCASP_0_CTRL_REGS);
/* make sure that the XDATA bit is cleared to zero */
: |5 U, z. b) g& }' zwhile(McASPTxStatusGet(SOC_MCASP_0_CTRL_REGS) & MCASP_TX_STAT_DATAREADY);
/* Activate the state machines */
4 p! D9 n2 j% l# e' Z# MMcASPRxEnable(SOC_MCASP_0_CTRL_REGS);
& m, W9 O! ^" Y% v4 X3 DMcASPTxEnable(SOC_MCASP_0_CTRL_REGS);1 V0 [3 e" U) k1 a9 I
}

- J) i; m0 B5 M# P4 ]2 g- G* a' n
请问:问题出在哪了,时钟按照这样配是否有错。
另外我看XDATA一直是0,接收的rxbuf0,1,2里有一般全是FFFF一半全是0.
- o$ b; K6 Q- J
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