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Omapl138 emif cs5 挂接16c554总线没有动作问题

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发表于 2014-11-26 11:32:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
您好! 我们使用 创龙omapl138核心板 + 自制底板的方案通过emif cs5 扩展 16c554,使用最新的u-boot和内核,通过sd卡启动,内核和文件系统全部在SD卡上,在这种情况下在Board_da850_evm.c中的da850_set_emif_clk_rate里修改设置CE5CFG寄存器值为0x8005,用来设置EMIF总线频率为456M/6=76M,但是发现操作CS5对应的ioremap后的地址,总线地址线并没有动作。我想请教一下:) U) X5 E- ^: U/ t4 |
9 q. u, n7 x6 [6 E, @7 t+ o, u
1.最新的u-boot里的emif总线频率设置是多少?在u-boot中从SD卡启动内核和运行文件系统,emif总线是否使能了?6 W: Z0 W* g9 S' r% F: D
2.在board_da850_evm.c中的da850_set_emif_clk_rate里修改设置CE5CFG寄存器值为0x8005, 这样设置是否能起作用?; ?& m1 }' h$ J8 \. Q. O4 d( m
3.要让cs5正常工作需要注意哪些寄存器的设置,目前只设置了CE5CFG寄存器。3 G) C/ I8 S' v! b) K
% o7 e" m3 x# J2 L2 a2 @
搞了好久CS5都不能正常工作,还请帮忙解答一下疑问,多谢!
# n5 m' G" ~& B
4 i+ s( Y* i1 G; ^- {0 y. j
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 楼主| 发表于 2014-11-26 22:20:57 | 只看该作者
纠正一下问题 OMAPL138的U-BOOT和内核设置PLLM和POSTDIV之后到SYS0_CLK3的频率是多少,内核默认配置sys0_clk3的分频系数是2 也就是div3) F; t& R1 B" i& ^/ I0 r
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发表于 2014-11-27 10:03:11 | 只看该作者
1.最新的u-boot里的emif总线频率设置是多少?在u-boot中从SD卡启动内核和运行文件系统,emif总线是否使能了?6 u& R; [  h& q
现在emifa在u-boot里面配置的频率是114M;无论从那个地方启动,emifa总线模块是使能的。7 @7 j7 o$ s/ L- P( M) l4 Q8 D  k$ ?
2.在board_da850_evm.c中的da850_set_emif_clk_rate里修改设置CE5CFG寄存器值为0x8005, 这样设置是否能起作用?
# z$ u1 \' F( h6 K# F7 h' d$ a( G可以起作用的,不过需要使用ioremap对物理地址做映射,内核才能访问。4 Z$ I  L0 o9 }8 E8 d
3.要让cs5正常工作需要注意哪些寄存器的设置,目前只设置了CE5CFG寄存器。4 j! t8 x: s, r  r
下面我给的是CS2的一个配置例子,您可以参考下:
: a* T( z: H0 z4 Y& i4 t, Z#define DA8XX_AEMIF_CE2CFG_OFFSET        0x102 h: q# a7 }5 b& _( f) ]
#define DA8XX_AEMIF_CE4CFG_OFFSET        0x18
( S, l) [: M5 D+ H( Q  h#define DA8XX_AEMIF_CE5CFG_OFFSET        0x1c1 j3 z9 N) r( P9 w
#define DA8XX_AEMIF_ASIZE_MASK                0x3# e4 Z: e  w1 t+ h8 Z/ \
#define DA8XX_AEMIF_ASIZE_16BIT                0x1
. S% |8 c8 o4 b3 ?! s' H7 c8 [#define DA8XX_AEMIF_ASIZE_8BIT                0x0
. j0 `- }, o8 y* B" _. j9 v0 X  d- K
" K. J: z, |' |# ^" ]#if defined(CONFIG_MACH_DAVINCI_DA850_PHYSMAP_FLASH)
! i; S$ }7 V1 O& ]- M) R5 u4 u' W7 M  ?static void __init da850_evm_init_nor(void)
! H# e5 x$ [& t' z{
! e& c, v# t: ~( Z        void __iomem *aemif_addr;  E" m# z: }% ~

1 ]/ J5 m( p/ q9 g        aemif_addr = ioremap(DA8XX_AEMIF_CTL_BASE, SZ_32K);8 [3 N5 z3 H9 V

' b4 h1 L8 ~' T, k" o+ P. v        /* Configure data bus width of CS2 to 16 bit */( f5 G, q" W% Y
        writel(readl(aemif_addr + DA8XX_AEMIF_CE2CFG_OFFSET) |
* ?- p2 N2 X" y* L                DA8XX_AEMIF_ASIZE_16BIT,5 d( p) J- T* E  \
                aemif_addr + DA8XX_AEMIF_CE2CFG_OFFSET);- V5 ^* G) L4 H% c! @0 f# `
- S4 X" J# ~6 X. b( U  i8 ~
        iounmap(aemif_addr);
% O9 ^3 f$ H6 d2 R( w9 k}( v# D/ S2 ?3 z* R; D+ `. q# x
#endif6 r2 g8 z% s2 s& }) I; z( @) o
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 楼主| 发表于 2014-11-27 14:10:17 | 只看该作者
teddy 发表于 2014-11-27 10:03) Z5 q" r, d* u
1.最新的u-boot里的emif总线频率设置是多少?在u-boot中从SD卡启动内核和运行文件系统,emif总线是否使能了 ...

% e3 w) ^% O8 y6 ]+ l2 u多谢您的解答,还有些问题没搞明白
1 K: `  }7 }! g. ~0 ~2 W; f) s1.目前我在board_da850_evm.c中的da850_set_emif_clk_rate里打印出来sys0_clk3的寄存器为0x8002 也就是div3 = 76M, 可是在davinci_nand.c中的davinci_aemif_setup_timing初始化nand时序时设置时使用的时钟频率为aemif,而aemif在clk初始化的时候添加打印打印出来的时钟是114000000,这样的话EMIF是哪一个频率?. ?- i% x5 t9 W5 A
        aemif_clk = clk_get(NULL, "aemif");# a# h1 }9 H3 z
        if (IS_ERR(aemif_clk))# t: C3 j3 X1 k! }5 J
                return PTR_ERR(aemif_clk);  a0 a) X! `8 N9 C# w: c

4 x; u5 r0 q! C        clkrate = clk_get_rate(aemif_clk);- P3 R! R: T* n- W- X/ |7 ?

! ~' i7 |9 n7 q# z        clkrate /= 1000;        /* turn clock into kHz for ease of use */6 T9 P; f8 L; c5 G. J% B
, B0 d  j; C1 l6 ~9 X
        ta        = aemif_calc_rate(t->ta, clkrate, TA_MAX);
, b# n) I0 J) x; x( O        rhold        = aemif_calc_rate(t->rhold, clkrate, RHOLD_MAX);
5 W5 X" Z; B7 p4 \7 E        rstrobe        = aemif_calc_rate(t->rstrobe, clkrate, RSTROBE_MAX);" d$ \& M- M6 m, X* ]! h
        rsetup        = aemif_calc_rate(t->rsetup, clkrate, RSETUP_MAX);# V4 `  h2 e6 D1 {# ~6 B- H
        whold        = aemif_calc_rate(t->whold, clkrate, WHOLD_MAX);% }' {- m& J( ?
        wstrobe        = aemif_calc_rate(t->wstrobe, clkrate, WSTROBE_MAX);
. y. W5 T% U5 e' ~3 v3 g        wsetup        = aemif_calc_rate(t->wsetup, clkrate, WSETUP_MAX);4 k0 R$ _1 h/ ~8 Q" f% K
2.我的板子上接的16c554只连接了8根数据线,所以设置成8bit数据位宽,地址线接了A15---A10结合片选CS5做译码,A4---A2接到16C554的A2--A0, 在这种情况下不停的用内核定时器访问0x6600E000物理地址进行 io_remap后的虚拟地址,板子上cs5没有动作,地址线上只有A2-A0有动作,我们这样的硬件设计和软件配置有没有问题,是不是应该配置成16位数据位宽,计算CS5的物理地址是不是应该做一下地址移位和映射?+ Z9 C% C, \( a5 C& E; o: u
. g+ s# Q& D3 ]; |9 f
期待您的解答。+ |7 X, x' ]. Y$ G" o
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发表于 2014-11-30 16:48:54 | 只看该作者
你好,456/4=114M。请注意emifa 8bit 数据的连接方式(如附件)。
$ P5 c. _/ {, k& M! [& a* A9 c8 z: p/ Y0 U' ~5 e8 J0 s: A! p

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 楼主| 发表于 2014-12-1 14:19:34 | 只看该作者
teddy 发表于 2014-11-30 16:48
+ x7 p3 B9 D4 v1 A7 C) Q你好,456/4=114M。请注意emifa 8bit 数据的连接方式(如附件)。

" V. l9 ~. M& r/ ^6 I+ m好的! teddy, EMIF时钟频率还是没搞清楚,在开发板系统起来之后,通过仿真器去查看寄存器 prediv、pllm和postdiv以及pll0_sysclk3寄存器, prediv 的ratio = 0,pllm的值为18, postdiv的ratio = 0, pll0_sysclk3的ratio = 00010,
" [  J/ ?; A# C0 {  g- ^如果核心板用的是24M晶振,那么24x1= 24, 24 x 19 = 456, 456/1 = 456, 456/3 = 152, 那么EMIF应该是152M, 可是davinci_nand.c中按照aemif的114M频率来配置时序,能否帮忙详细解释一下开发板的时钟频率的设置。
: q. w! L) `. N4 n- j) n% {7 O0 K
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发表于 2014-12-1 22:39:46 | 只看该作者
您好!请确认你的pll0_sysclk3的ratio = 00010是否正确,这里的值应该是0x8003。
' k* j7 g$ X- v
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 楼主| 发表于 2014-12-2 08:32:24 | 只看该作者
teddy 发表于 2014-12-1 22:39
, l$ |" N/ ^3 r您好!请确认你的pll0_sysclk3的ratio = 00010是否正确,这里的值应该是0x8003。

/ G8 g0 p4 ~9 n1 Mteddy,  pll0_sysclk3的值是0x8002,内核是百度网盘上2014.11.06最新版本 + M, b( E% Q3 A9 e% c- h
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 楼主| 发表于 2014-12-2 08:37:13 | 只看该作者
在11.06号的内核代码里board-da850-evm.c的da850_evm_init中会调用da850_set_emif_clk_rate函数去设置pll0_sysclk3寄存器为0x8002,通过仿真器,从dsp端读出的寄存器值也是0x8002
0 s/ r% v/ c: t) ~
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