6657的JTAG口的TCLK时钟速率是由什么决定的？是由SYSCLK2？

创龙科技support

您好，若是仿真器的TCK，该时钟是独立时钟信号，可搜索JTAG的引脚说明查阅详细介绍，在CCS的仿真配置文件中可设置JTAG的TCLK，一般默认200v2型号仿真器为10MHz。若是设计板卡的JTAG口，参考我司的设计即可。

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tonyflair 发表于 2022-5-21 09:55
多谢解答。
那还请教一下:6657的SYSCLK2时钟决定的是CorePac emulation的什么?模块工作频率吗？ ...

您好，可以查看数据手册关于SYSCLK的说明。