对l138与fpga通信例程tl-devmem2的复现与使用 - OMAP-L138 - 嵌入式开发者社区 - 51ele.net
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[已解决] 对l138与fpga通信例程tl-devmem2的复现与使用

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发表于 2018-9-5 20:16:08 | 显示全部楼层 |阅读模式
硬件平台:omapl38F核心板;( e4 E. S# ^; R/ \, m' @9 }  R
复现方式:按照pdf:omapl38基于emifa总线与FPGA的通信测试进行例程复现,并将写数据部分提取出来进行使用;
  @3 k8 \6 e  g. b$ _4 G% H问题:在对fpga这边数据进行抓包观察时发现:+ n$ Y+ e( l, _' s* J3 \$ ]3 E
1、16根数据线仅有低八位在使用,高八位置一,当传输16bit数据时,会将两个字节按先小端后大端的顺序从低八位数据线按序输出;
: p5 J4 E, o) [% ]2、同时地址线只有addr1,addr2,addr3三根是有效的,其他线长期置一,并且地址线并不随数据变化而变化,而是每隔8到11个写使能而进一位;
8 Q' k5 k8 S4 [8 R( z7 O3、emifa_clk时钟线并不能作为时钟提供给fpga,在对fpga另加其他时钟并对emifa_clk进行抓包时现象为长期置高;4 y6 T7 a8 L  e! L1 E
4、片选emifa_cs2和写使能emifa_we的拉低时间比并不符合dsp与fpga通信时的2,3,2关系,请问arm与fpga通信时这个时序是什么,同时其依靠的时钟是多大,还是114MHz吗?
3 E/ F# E4 K) V% ~4 B

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发表于 2018-9-7 15:39:11 | 显示全部楼层
你好,针对您的问题有一下疑问:
, e+ h2 _# K. W& ]0 ?. _. D# s0 I- \( \( H
1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?/ C. C9 F* ?& ]
2.是否有确认过FPGA端的程序与DSP端的程序数据传输的位数是否匹配?
6 D9 _; i2 v" y/ H' M, g8 }- Y
+ [% ~2 P( J6 c( N: j
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 楼主| 发表于 2018-9-7 16:26:05 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 15:39! n1 a  A4 m1 H3 A
你好,针对您的问题有一下疑问:- `' [' T# C' }
& H) W6 F  |4 g
1.请问你使用的程序都是用我公司提供的吗?还是自行有做修改?

$ c4 n! d" v6 d) ]# X使用的是arm的例程tl_devmem2(贴的图是修改过的程序,写使能中间的长时间时序是由于arm端打印每次数据造成的);我没有用核心板上的DSP,只用了arm和fpga
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发表于 2018-9-7 17:06:59 | 显示全部楼层
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》
6 m6 S. e* _! A
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 楼主| 发表于 2018-9-7 20:43:44 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:06" Y4 Q; j9 o. S( Z5 M+ x, U; K
数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...

! y* ?0 F" A: l4 _就是按照那个文档操作的,然后发现采用m或者h模式的时候数据线和地址线出现了上述现象。采用b时地址线出现上述现象8 o) R: H' {8 y' B$ a
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 楼主| 发表于 2018-9-17 17:09:55 | 显示全部楼层
Tronlong-陈工 发表于 2018-9-7 17:06
2 q7 h2 K# ]3 W( E+ j4 Y& I数据的问题核对过ARM和FPGA端的数据宽度是否匹配?光盘资料中也有使用tl_devmem2的部分讲解文档《13-3-OMAP ...
" ^# k& F+ ~" s! r: n  A. O
陈工,这个问题咱们创龙有没有解决方案啊,为什么ARM和fpga通信时只能用8根数据线啊,而且地址线完全和数据不匹配,而且arm进行写操作基于的时钟是多少啊?麻烦您解答一下呗
; z; D- p+ P2 a  U9 R
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发表于 2018-9-29 10:46:15 | 显示全部楼层
您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看一下。
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 楼主| 发表于 2018-11-10 16:06:15 | 显示全部楼层
广州创龙莫工 发表于 2018-9-29 10:46
; q9 J4 Y: {3 |7 ]; d- u您好,您如果是按照我们提供的例程和文档进行测试的话,测试的结果如果是不一样的话,您这边可以截图过来看 ...
/ D( x# x  N- W
采用的OMAP-L138F上ARM与FPGA数据传输程序基于文件《13-3-OMAPL138基于EMIFA总线与FPGA的通信测试》。& Y) X) I4 H* v& `

9 f# `( @  G, y. O( L9 y9 U现在遇到的问题:3 i; c: s% l% M& N& X. m/ p
1、16bit数据线高八位没有初始化,传输只采用低八位数据线,且16bit的数据会在低八位数据线分成两个8bit数发出;
- C: q& t. ~' P! X2、地址线仅有低三位初始化,且变化方式与读使能不同步;emifa_ba1无变化;, L2 u* x# y$ Z3 n/ [
( w/ x% j% ?  f" H, |5 I
现象:8 O& K7 E+ i9 i! @+ \2 c/ I
1、linux端运行./tl-devmem2 0x60000000 256 m 52428(1100110011001100)FPGA端现象
9 F1 [& @3 r4 w% h# O8 mG:\EMIF问题\输入(m52428)( v, L7 R2 q  h
G:\EMIF问题\m52428addr- `! g9 r& K1 _" G% p* \
2、linux端运行./tl-devmem2 0x60000000 256 h 52428(1100110011001100)FPGA端现象
( s4 S, F! [2 Q0 x  j5 H0 gG:\EMIF问题\输入(h52428)G:\EMIF问题\h52428addr
( B  J' k6 C  x' \# U, P' {
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 楼主| 发表于 2018-11-10 16:09:43 | 显示全部楼层
( D, A  u4 d" s6 I* y
5 f, @6 A: D  F

; w. S2 d0 L% {# D! f4 _* y7 x# I- D  S7 a- m" V

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发表于 2018-11-22 12:02:47 | 显示全部楼层
你好,emif的问题我们这边基本确认了。除了fpga端下载bit文件之后运行这几条指令再发送数据以外,需要加载这个驱动:tl138evm-emifa-sram,还有两个情况::1.tl138evm-emifa-sram这个驱动有bug,导致地址发送出错。2.FPGA端的程序也有点问题,频率太高,通信会出错。。以上的问题我们会在V2.1版本(目前使用的是2.0内核)更新完善上去。并且修改emif的FPGA端程序。新版本的内核发布时间是下周五(11月30日)/ J5 q  o7 b+ o- S1 O

5 E, y6 ^2 O# ]8 S; c; G' I# q0 J! y! C( Q% |7 I

! M: b  N- s, Z; e5 b& n

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