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TL138 EthEVM-A2 開發板 EMIFA 問題

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发表于 2016-8-9 09:15:17 | 显示全部楼层 回帖奖励 |倒序浏览 |阅读模式
創龍工程師, 您好:
   我購買TL138 EthEVM-A2 開發板, 目前用 demo code 雙核通訊都可正常運行, 經由DSP控制 EMIFA 使用CS2與外部FPGA做資料連結.
      使用光碟所提供的  EMIFA_FPGA 代碼, 目前外部是空接LA分析其 EMIF 發送的資料, 發現一個奇怪的問題!
1. 外部空接情況, 不論資料如何發送(0x0001 or  0x1ffff), 其D0 一直保持為低電壓;
2. D0外部上拉1K電阻後, 不論資料如何發送(0x0000), 其D0 一直保持為高電壓;
& d3 A& D# s0 `$ a0 K
其餘 bus (D15 ~ D1), CS2, R/W, WE... 可正常控制, 唯有D0 !?
8 k& l- o8 R) S# h1 k
因為是參考創龍提供的源碼, 也試過調整時序(write-setup, strobe,hold/ Read-setup, strobe, hold) 幫助不大;
回讀PLLDIV3(0x01E1A120) =0x8003, 表示EMIF Clock 114MHz

3 Z! k$ e6 m1 [- e+ b4 h
void EMIFInit(void)
{
                //配置EMIFA相關复用引腳
                EMIFAPinMuxSetup();
               
                //配置數據總線16bit
                EMIFAAsyncDevDataBusWidthSelect(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2,        EMIFA_DATA_BUSWITTH_16BIT);
               
                //選擇 Normal 模式
                EMIFAAsyncDevOpModeSelect(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_ASYNC_INTERFACE_NORMAL_MODE);
               
                //禁止 WAIT 引腳
                EMIFAExtendedWaitConfig(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_EXTENDED_WAIT_DISABLE);
               
                //配置 W_SETUP/R_SETUP   W_STROBE/R_STROBE    W_HOLD/R_HOLD        TA 等參數
                EMIFAWaitTimingConfig(SOC_EMIFA_0_REGS,EMIFA_CHIP_SELECT_2, EMIFA_ASYNC_WAITTIME_CONFIG(1, 2, 1, 1, 2, 1, 0 ));
}

8 y# E  D1 J: ^6 j9 `
0 r  @# ?9 K7 a# T+ B( x' V

7 V+ X$ n/ I' e. I' C! s2 G0 r! I7 t' ?
' A+ d) H/ G+ }& z# r# n

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 楼主| 发表于 2016-8-10 14:05:15 | 显示全部楼层
您好, 很感謝你的回覆; R8 f# i( @9 Z- \' Y" O
我使用你的方法, 把 EMIFA_D0 ~ D7 定義為 GP4[8] ~ GP[15], 所量測的波形 GP4[8]與其它GP4[9~ 15] 比對, 確實不太一樣.
! D1 _+ R/ w7 O: {% ]4 \* v+ Q& u6 j  i' c9 V2 c* C
我有針對 EMIFA_D0 查過底板, 只經由 RN6_22R 串接到 LAN9221-ABZJ, 故意去除RN6_22R, 也是有相同問題!  
4 C) x- e0 Y9 e
2 @9 e8 h' A7 Q, m不知 EMIFA_D0 這腳位是否跟核心板 nand flash 或其它硬件有關? + I$ n& U! ~( ]0 z! [
3 ^  P- U# D$ j7 C
在請您協助釐清, 謝謝~

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 楼主| 发表于 2016-8-17 12:11:07 | 显示全部楼层
創龍工程師, 您好 :
  Z, |7 i. ~9 T" }& a  使用 TL138 EthEVM-A2 開發板測試 EMIFA 功能, 改用單核(C6748)來測試GPIO4[8]~[15], GPIO[8] 也是有如上圖問題!!!
4 H6 C+ j8 Z6 y' a1 Q  x7 I  D, N+ T  C! j
不知 EMIFA 異同步功能在 TL138 EthEVM-A2 開發板是否真能實現!? 或有其它高手能回應此狀況, 十分感謝~
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 楼主| 发表于 2016-9-12 10:30:48 | 显示全部楼层
Hi, Felix:
4 O, l5 w+ s, v% n0 n  謝謝你的回覆, 上述的問題描述及GPIO測試, 因DSP初始化於 PIN ASSIGNE 已做內部 pull high, 所以其外部都處於空接的狀態, 直接用示波器及LA量測信號;
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