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EMIFA与FPGA通讯问题请教?

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发表于 2015-1-27 21:29:38 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
DSP通过EMIFA与FPGA通讯,请问 建立时间 选通时间 保持时间 如何确定?谢谢!; v2 @; _0 ~; W# U2 T, [6 p

/ k$ p+ h# x( \4 U6 N9 r9 V
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沙发
发表于 2015-2-1 15:53:04 | 只看该作者
通过实验将各个时间逐渐减小,直到通信出错,这样是最简单的方法。
, ], \8 h/ O% \6 {8 o
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板凳
 楼主| 发表于 2015-2-2 13:31:34 | 只看该作者
哦,原来是这样啊,我试试,多谢了!' [+ F* F# r4 X
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